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参数资料
| 型号： | CA3304 |
| 厂商： | Intersil Corporation |
| 元件分类： | 串行ADC |
| 英文描述： | 4-Bit, 25 MSPS, Flash A/D Converters(4位、采样速率为25MSPS、闪速A/D转换器) |
| 中文描述： | 4位，25 MSPS的，闪光的A / D转换器（4位，采样速率为25Msps时，闪速的A / D转换器） |
| 文件页数： | 5/11页 |
| 文件大小： | 117K |
| 代理商： | CA3304 |
4-11
Functional Diagram
Timing Diagrams
FIGURE 1. TIMING DIAGRAM
FIGURE 2. OUTPUT ENABLE/DISABLE TIMING
Cascaded Auto Balance (CAB)
NOTE: CE1 and CE2 inputs and data outputs have standard CMOS protection networks to V
DD
and V
SS
. Analog inputs and clock have
standard CMOS protection networks to V
AA
+ and V
AA
-.
9
7
1
D Q
CLK
D Q
CLK
D Q
CLK
D Q
CLK
D Q
CLK
D Q
CLK
5
2
3
4
6
ENCODER
LOGIC
ARRAY
D
LATCH
16
Q
COUNT
16
COUNT
8
Q
D
LATCH
8
D
LATCH
0
Q
COUNT
1
8
14
V
AA
-
V
SS
CAB COMPARATOR #1
φ
1 (AUTO BALANCE)
φ
2 (SAMPLE UNKNOWN)
50k
CLOCK
15
13
V
REF
-
V
REF
+
V
IN
11
12
16
10
V
AA
+
V
DD
φ
1
φ
1
φ
1
φ
1
φ
2
φ
2
1
/
2
R
1
/
2
R
R
R
R
CAB #8
CAB #16
OUTPUT
REGISTER
THREE-STATE
DRIVERS
DATA
CHANGE
OVERFLOW
BIT 4
BIT 3
BIT 2
BIT 1 (LSB)
CE1
CE2
R
CLOCK
B1 - B4, DC & OF
COMPARATOR DATA
LATCHED
DATA VALID 2
φ
1
AUTO
BALANCE
φ
2
t
HO
1
1
0
0
AUTO
BALANCE
AUTO
BALANCE
SAMPLE 1
SAMPLE 2
SAMPLE 3
DATA SHIFTED INTO
OUTPUT REGISTERS
DATA VALID 1
DATA VALID 0
t
D
BITS 1-4
DC, OF
t
DIS
HIGH
CE2
CE1
IMPEDANCE
HIGH
IMPEDANCE
HIGH
IMPEDANCE
t
EN
t
EN
t
DIS
CA3304, CA3304A
相关PDF资料 |
PDF描述 |
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参数描述 |
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