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参数资料
| 型号： | CK-S6-SP623-G |
| 厂商： | Xilinx Inc |
| 文件页数： | 17/48页 |
| 文件大小： | 0K |
| 描述： | BOARD DEV S6 WITH TX |
| 标准包装： | 1 |
| 系列： | Spartan®-6 |
| 类型： | FPGA |
| 适用于相关产品： | Spartan?-6 FPGA，XC6SLX150T |
| 所含物品： | 板，线缆，文档，电源，软件 |
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Detailed Description
X-Ref Target - Figure 1-7
U1
FPGA
TCK
TDO
TDI
TMS
Figure 1-7:
U25
System ACE
Controller
J196
CFGTCK
J195
CFGTDI
J23
CFGTDO
J22
CFGTMS
UG751_c1_07_050110
JTAG Isolation Jumpers
Table 1-4:
JTAG Isolation Jumpers
Reference Designator
J22
J23
J195
J196
FPGA Pin Name
TMS
TDI
TDO
TCK
200 MHz 2.5V LVDS Oscillator
The SP623 board has one 2.5V LVDS differential 200 MHz oscillator (U7) connected to the
FPGA global clock inputs. Table 1-5 lists the FPGA pin connections to the LVDS oscillator.
The 200 MHz differential clock is enabled by placing two shunts (P, N) across J188 header
pins 1–3 and 2–4 (LVDS).
Table 1-5:
LVDS Oscillator Global Clock Connections
FPGA Pin
V23
W24
Net Name
IO_LVDS_CLK_P
IO_LVDS_CLK_N
U7 Pin
4
5
SuperClock-2 Module
The SuperClock-2 module connects to the clock module interface connector (J32) and
provides a programmable, low-noise clock source for the SP623 board. The clock module
maps to FPGA I/O by way of 24 control pins, 3 LVDS pairs, 1 regional clock pair, and 1
reset pin. Table 1-6 shows the FPGA I/O mapping for the SuperClock-2 module interface.
The SP623 board also supplies VCC5, VCC3V3, VCC2V5, and VCCO input power to the
clock module interface.
SP623 Board User Guide
UG751 (v1.1) September 15, 2010
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PDF描述 |
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参数描述 |
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