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参数资料
| 型号： | COP8SGE740M8 |
| 厂商： | National Semiconductor Corporation |
| 英文描述： | LP2950/LP2951 Series of Adjustable Micropower Voltage Regulators; Package: TO-252; No of Pins: 3 |
| 中文描述： | 8位的CMOS基于ROM和OTP微控制器具有8K到32K的内存，2个比较器和USART |
| 文件页数： | 52/62页 |
| 文件大小： | 913K |
| 代理商： | COP8SGE740M8 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页当前第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页
14.0 Instruction Set
(Continued)
14.7 INSTRUCTION EXECUTION TIME
Most instructions are single byte (with immediate addressing
mode instructions taking two bytes).
Most single byte instructions take one cycle time to execute.
Skipped instructions require x number of cycles to be
skipped, where x equals the number of bytes in the skipped
instruction opcode.
See the BYTES and CYCLES per INSTRUCTION table for
details.
Bytes and Cycles per Instruction
The following table shows the number of bytes and cycles for
each instruction in the format of byte/cycle.
Arithmetic and Logic Instructions
[B]
1/1
1/1
1/1
1/1
1/1
1/1
1/1
1/1
1/1
Direct
3/4
3/4
3/4
3/4
3/4
3/4
3/4
3/4
Immed.
2/2
2/2
2/2
2/2
2/2
2/2
2/2
2/2
ADD
ADC
SUBC
AND
OR
XOR
IFEQ
IFGT
IFBNE
DRSZ
SBIT
RBIT
IFBIT
1/3
3/4
3/4
3/4
1/1
1/1
1/1
RPND
1/1
Instructions Using A & C
CLRA
INCA
DECA
LAID
DCORA
RRCA
RLCA
SWAPA
SC
RC
IFC
IFNC
PUSHA
POPA
ANDSZ
1/1
1/1
1/1
1/3
1/1
1/1
1/1
1/1
1/1
1/1
1/1
1/1
1/3
1/3
2/2
Transfer of Control Instructions
JMPL
JMP
JP
JSRL
JSR
JID
VIS
RET
RETSK
RETI
INTR
NOP
3/4
2/3
1/3
3/5
2/5
1/3
1/5
1/5
1/5
1/5
1/7
1/1
Memory Transfer Instructions
Register
Indirect
[B]
1/1
1/1
Direct
Immed.
Register Indirect
Auto Incr. & Decr.
[B+, B]
1/2
1/2
[X]
1/3
1/3
[X+, X]
1/3
1/3
X A, (Note 18)
LD A, (Note 18)
LD B, Imm
LD B, Imm
LD Mem, Imm
LD Reg, Imm
IFEQ MD, Imm
2/3
2/3
2/2
1/1
2/2
(If B
<
16)
(If B
>
15)
2/2
3/3
2/3
3/3
2/2
Note 18:
=
>
Memory location addressed by B or X or directly.
C
www.national.com
52
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PDF描述 |
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