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参数资料
| 型号： | CS4223-KS |
| 厂商： | CRYSTAL SEMICONDUCTOR CORP |
| 元件分类： | 消费家电 |
| 英文描述： | IC EEPROM SRL 1024X8BIT 8DIP |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PDSO28 |
| 封装： | SSOP-28 |
| 文件页数： | 13/32页 |
| 文件大小： | 778K |
| 代理商： | CS4223-KS |
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CS4223 CS4224
DS290PP3
13
5. REGISTER DESCRIPTIONS - CS4224
Note: All registers are read/write in I
2
C mode and write-only in SPI mode, unless otherwise noted.
5.1
ADC Control (address 01h)
5.1.1
POWER DOWN ADC (PDN)
Default = 0
0 - Disabled
1 - Enabled
Function:
The ADC will enter a low-power state when this function is enabled.
5.1.2
LEFT AND RIGHT CHANNEL HIGH PASS FILTER DEFEAT (HPDR-HPDL)
Default = 0
0 - Disabled
1 - Enabled
Function:
The internal high-pass filter is defeated when this function is enabled. Control of the internal high-
pass filter is independent for the left and right channel.
5.1.3
LEFT AND RIGHT CHANNEL ADC MUTING (ADMR-ADML)
Default = 0
0 - Disabled
1 - Enabled
Function:
The output for the selected ADC channel will be muted when this function is enabled.
5.1.4
CALIBRATION CONTROL (CAL)
Default = 0
0 - Disabled
1 - Enabled
Function:
The device will automatically perform an offset calibration when brought out of reset, which last ap-
proximately 50 ms. When this function is enabled, a rising edge on the reset line will initiate an offset
calibration.
5.1.5
CALIBRATION STATUS (CALP) (READ ONLY)
Default = 0
0 - Calibration done
1 - Calibration in progress
7
6
5
4
3
2
1
0
PDN
0
HPDR
0
HPDL
0
ADMR
0
ADML
0
CAL
0
CALP
0
CLKE
0
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
|---|---|
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