参数资料
| 型号： | CS4354-CSZ |
| 厂商： | Cirrus Logic Inc |
| 文件页数： | 23/24页 |
| 文件大小： | 0K |
| 描述： | IC DAC 24BIT SRL 14SOIC |
| 特色产品： | CS4354 Stereo D/A Converter |
| 标准包装： | 48 |
| 位数： | 24 |
| 数据接口： | 串行 |
| 转换器数目： | 1 |
| 电压电源： | 单电源 |
| 功率耗散（最大）： | 65mW |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 14-SOIC（0.154"，3.90mm 宽） |
| 供应商设备封装： | 14-SOIC |
| 包装： | 管件 |
| 输出数目和类型： | 2 电压，单极 |
| 采样率（每秒）： | 192k |
| 产品目录页面： | 757 (CN2011-ZH PDF) |
| 其它名称： | 598-1808 CS4354-CSZ-ND |
8
DS895F2
CS4354
SWITCHING SPECIFICATIONS - SERIAL AUDIO INTERFACE
12. Not all sample rates are supported for all clock ratios. See Section 4.2 “Sample Rate Range/Operational
Mode Detect” on page 13 for supported ratios and frequencies. SSM = Single-Speed Mode,
DSM = Double-Speed Mode, QSM = Quad-Speed Mode.
13. SCLK period is defined by the SCLK / LRCK ratio. The SCLK/LRCK ratio may be either 32, 48, or 64.
See Table 5 on page 14.
14.
Parameters
Symbol
Min
Typ
Max
Units
MCLK frequency
7.6
-
55.3
MHz
MCLK duty cycle
35
-
65
%
Input sample rate
All MCLK/LRCK ratios combined
(SSM) 256x, 384x, 512x, 768x, 1024x
(DSM) 128x, 192x, 256x, 384x, 512x
(QSM) 128x, 192x, 256x
Fs
30
84
170
-
216
54
108
216
kHz
External SCLK Mode
LRCK duty cycle
45
-
55
%
SCLK pulse width low
tsclkl
20
-
ns
SCLK pulse width high
tsclkh
20
-
ns
SCLK duty cycle
45
-
55
%
SCLK rising to LRCK edge delay
tslrd
20
-
ns
LRCK edge to SCLK rising delay
tslrs
20
-
ns
SDIN valid to SCLK rising setup time
tsdlrs
20
-
ns
SCLK rising to SDIN hold time
tsdh
20
-
ns
Internal SCLK Mode
LRCK duty cycle
--
SCLK period
tsclkw
--
ns
MCLK falling to LRCK edge
tmclkf
-ns
LRCK edge to SCLK rising
tsclkr
-
-ns
SDIN valid to SCLK rising setup time
tsdlrs
--
ns
SCLK rising to SDIN hold time
MCLK / LRCK = 1024, 512, 256, 128
tsdh
--
ns
MCLK / LRCK = 768, 384, 192
-
50%
1
2MCLK
----------------------------
–
50%
1
2MCLK
----------------------------
+
109
SCLK
----------------
109
–
4MCLK
---------------------------
109
4MCLK
---------------------------
109
512
Fs
-----------------------
10
+
109
512
Fs
-----------------------
15
+
109
384
Fs
-----------------------
15
+
t
sclkr
t
sclkw
2
-----------------
10
9
2MCLK
---------------------------t
mclkf
++
=
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