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参数资料
| 型号： | CY39200V256-233BGC |
| 厂商： | Cypress Semiconductor Corp. |
| 英文描述： | CPLDs at FPGA Densities |
| 中文描述： | CPLD器件在FPGA的密度 |
| 文件页数： | 51/86页 |
| 文件大小： | 1235K |
| 代理商： | CY39200V256-233BGC |
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Delta39K ISR
CPLD Family
Document #: 38-03039 Rev. *H
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IO7
IO7
IO7
IO7
IO7
IO7
IO7
IO7
IO7
IO7
IO/V
REF7
V
CCIO7
IO7
IO7
IO7
IO7
IO/V
REF7
IO7
IO7
V
CCIO7
IO7
IO/V
REF7
IO7
IO7
IO7
GND
GCLK3
GND
GCTL3
IO/V
REF7
V
CCIO7
IO7
IO7
IO7
IO7
IO/V
REF7
IO7
IO7
V
CCIO7
IO7
IO/V
REF7
IO7
IO7
IO7
GND
GCLK3
GND
GCTL3
IO/V
REF7
V
CCIO7
IO7
IO7
IO7
IO7
IO/V
REF7
IO7
IO7
V
CCIO7
IO7
IO/V
REF7
IO7
IO7
IO7
GND
GCLK3
GND
GCTL3
IO/V
REF7
V
CCIO7
IO7
IO7
IO7
IO7
IO/V
REF7
IO7
IO7
V
CCIO7
IO7
IO/V
REF7
IO7
IO7
IO7
GND
GCLK3
GND
GCTL3
IO/V
REF7
V
CCIO7
IO7
IO7
IO7
IO7
IO/V
REF7
IO7
IO7
V
CCIO7
IO7
IO/V
REF7
IO7
IO7
IO7
GND
GCLK3
GND
GCTL3
Table 11. 208 EQFP/PQFP Pin Table
(continued)
Pin
CY39030
CY39050
CY39100
CY39165
CY39200
Table 12. 388 BGA Pin Table
Pin
A1
A2
A3
A4
A5
A6
A7
A8
A9
A10
A11
A12
A13
[19]
A14
[19]
A15
A16
A17
A18
CY39050
GND
NC
IO7
IO7
IO7
IO7
IO7
NC
IO7
IO7
IO/V
REF7
IO7
IO7
IO6
IO6
GND
IO6
IO6
CY39100
GND
IO7
IO7
IO7
IO7
IO7
IO7
IO/VREF7
IO7
IO7
IO/V
REF7
IO7
IO7
IO6
IO6
GND
IO6
IO6
CY39165
GND
IO7
IO7
IO7
IO7
IO7
IO7
IO/VREF7
IO7
IO7
IO/V
REF7
IO7
IO7
IO6
IO6
GND
IO6
IO6
CY39200
GND
IO7
IO7
IO7
IO7
IO7
IO7
IO/VREF7
IO7
IO7
IO/V
REF7
IO7
IO7
IO6
IO6
GND
IO6
IO6
Note:
19. Capacitance on these I/O pins meets the PCI spec (rev. 2.2), which requires IDSEL pin in a PCI design to have capacitance less than or equal to 8 pf. In the
document titled “Delta39K CPLD Family data sheet”, this spec is defined as C
PCI.
All other I/O pins have a capacitance less than or equal to 10 pf.
相关PDF资料 |
PDF描述 |
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| CY39200V256-233NC | CPLDs at FPGA Densities |
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相关代理商/技术参数 |
参数描述 |
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| CY39200V388-181MGC | 制造商:Cypress Semiconductor 功能描述: |
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