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参数资料
| 型号： | CY7C0852AV-133BBC |
| 厂商： | CYPRESS SEMICONDUCTOR CORP |
| 元件分类： | SRAM |
| 英文描述： | FLEx36™ 3.3V 32K/64K/128K/256K x 36 Synchronous Dual-Port RAM |
| 中文描述： | 128K X 36 DUAL-PORT SRAM, 4 ns, PBGA172 |
| 封装： | 15 X 15 MM, 1.25 MM HEIGHT, 1 MM PITCH, FBGA-172 |
| 文件页数： | 16/32页 |
| 文件大小： | 971K |
| 代理商： | CY7C0852AV-133BBC |
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CY7C0850AV, CY7C0851AV
CY7C0852AV, CY7C0853AV
Document #: 38-06070 Rev. *H
Page 23 of 32
Figure 19. Counter Reset[32, 33]
Switching Waveforms (continued)
CLK
ADDRESS
INTERNAL
CNTEN
ADS
DATAIN
ADDRESS
CNTRST
R/W
DATAOUT
An
Am
Ap
Ax
0
1
An
Am
Ap
Q1
Qn
Q0
D0
tCH2
tCL2
tCYC2
tSA tHA
tSW tHW
tSRST tHRST
tSD tHD
tCD2
tCKLZ
RESET
ADDRESS 0
COUNTER
WRITE
READ
ADDRESS 0
ADDRESS 1
READ
ADDRESS An
ADDRESS Am
READ
Notes
32. CE0 = B0 – B3 = LOW; CE1 = MRST = CNT/MSK = HIGH.
33. No dead cycle exists during counter reset. A Read or Write cycle may be coincidental with the counter reset.
34. Retransmit happens if the counter remains in increment mode after it wraps to initially loaded value.
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