参数资料
| 型号： | DAC8043AFS |
| 厂商： | Analog Devices Inc |
| 文件页数： | 4/8页 |
| 文件大小： | 0K |
| 描述： | IC DAC 12BIT MULT SRL INP 8-SOIC |
| 产品培训模块： | Data Converter Fundamentals DAC Architectures |
| 标准包装： | 98 |
| 设置时间： | 250ns |
| 位数： | 12 |
| 数据接口： | 串行 |
| 转换器数目： | 1 |
| 电压电源： | 单电源 |
| 功率耗散（最大）： | 500µW |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 8-SOIC（0.154"，3.90mm 宽） |
| 供应商设备封装： | 8-SO |
| 包装： | 管件 |
| 输出数目和类型： | 1 电流，单极；1 电流，双极 |
| 采样率（每秒）： | 4M |
REV. B
DAC8043A
–4–
SRI
CLK
LD
SRI
CLK
LD
FS
ZS
VOUT
DATA LOADED MSB(D11) FIRST
DAC REGISTER LOAD
D11
D10
D9
D8
D6
D5
D4
D3
D2
D1
D0
D7
tLD1
tDS
tDH
tCL
tCH
tLD
tS
1 LSB
ERROR BAND
Dxx
tASB
Figure 2. Timing Diagram
Table I. Control-Logic Truth Table
CLK
LD
Serial Shift Register Function
DAC Register Function
u
H
Shift-Register-Data Advanced One Bit Latched
H or L
L
No Effect
Updated with Current Shift Register Contents
L
u
No Effect
Latched All 12 Bits
NOTES
u positive logic transition.
The DAC Register
LD input is level-sensitive. Any time LD is logic-low data in the serial register will directly control the
switches in the R-2R DAC ladder.
TOTAL UNADJUSTED ERROR – LSB
FREQUENCY
15
20
0
–1.0
1.0
10
30
–0.5
0.0
0.5
SS = 200 UNITS
TA = 25 C
VDD = 5V
VREF = 10V
25
5
35
Figure 3. Total Unadjusted Error Histogram
Typical Performance Characteristics
FULL SCALE TEMPCO – ppm/ C
FREQUENCY
30
20
0
10
40
50
SS = 200 UNITS
TA = –40 C TO +85 C
VDD = 5V
VREF = 10V
12
Figure 4. Full-Scale Output Tempco Histogram
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