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参数资料
| 型号： | DS21352L+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 14/137页 |
| 文件大小： | 0K |
| 描述： | IC TXRX T1 1-CHIP 3.3V 100-LQFP |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 90 |
| 功能： | 单芯片收发器 |
| 接口： | HDLC，T1 |
| 电路数： | 1 |
| 电源电压： | 3.14 V ~ 3.47 V |
| 电流 - 电源： | 75mA |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 100-LQFP |
| 供应商设备封装： | 100-LQFP（14x14） |
| 包装： | 托盘 |
| 包括： | DSX-1 和 CSU 线路补偿发生器，HDLC 控制器，带内回路代码发生器和检测器 |
| 产品目录页面： | 1429 (CN2011-ZH PDF) |
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DS21352/DS21552
110 of 137
Figure 21-2 RECEIVE SIDE ESF TIMING
Notes:
1. RSYNC in frame mode (RCR2.4 = 0) and double wide frame sync is not enabled (RCR2.5 = 0)
2. RSYNC in frame mode (RCR2.4 = 0) and double wide frame sync is enabled (RCR2.5 = 1)
3. RSYNC in multiframe mode (RCR2.4 = 1)
4. ZBTSI mode disabled (RCR2.6 = 0)
5. RLINK data (FDL bits) is updated one bit time before odd frames and held for two frames
6. ZBTSI mode is enabled (RCR2.6 = 1)
7. RLINK data (Z bits) is updated one bit time before odd frames and held for four frames
8. RLINK and RLCLK are not synchronous with RSYNC when the receive side elastic store is enabled
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RFSYNC
FRAME#
TLCLK
RSYNC
TLINK
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2
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5
4
RLCLK
RLINK
5
7
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PDF描述 |
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参数描述 |
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