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参数资料
| 型号： | DS2155L+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 53/238页 |
| 文件大小： | 0K |
| 描述： | IC TXRX T1/E1/J1 1-CHIP 100-LQFP |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 90 |
| 功能： | 单芯片收发器 |
| 接口： | E1，HDLC，J1，T1 |
| 电路数： | 1 |
| 电源电压： | 3.14 V ~ 3.47 V |
| 电流 - 电源： | 75mA |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 100-LQFP |
| 供应商设备封装： | 100-LQFP（14x14） |
| 包装： | 管件 |
| 包括： | BERT 发生器和检测器，CMI 编码器和解码器，HDLC 控制器 |
| 产品目录页面： | 1429 (CN2011-ZH PDF) |
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DS2155
146 of 238
24.4 MCLK Prescaler
A 16.384MHz, 8.192MHz, 4.096MHz, 2.048MHz, or 1.544MHz clock must be applied at MCLK. ITU
specification G.703 requires an accuracy of ±50ppm for both T1 and E1. TR62411 and ANSI
specifications require an accuracy of ±32ppm for T1 interfaces. A prescaler divides the 16MHz, 8MHz,
or 4MHz clock down to 2.048MHz. There is an on-board PLL for the jitter attenuator, which converts the
2.048MHz clock to a 1.544MHz rate for T1 applications. Setting JAMUX (LIC2.3) to a logic 0 bypasses
this PLL.
24.5 Jitter Attenuator
The DS2155 contains an on-board jitter attenuator that can be set to a depth of either 32 or 128 bits
through the JABDS bit (LIC1.2). The 128-bit mode is used in applications where large excursions of
wander are expected. The 32-bit mode is used in delay-sensitive applications. The characteristics of the
attenuation are shown in Figure 24-9. The jitter attenuator can be placed in either the receive path or the
transmit path by appropriately setting or clearing the JAS bit (LIC1.3). Setting the DJA bit (LIC1.1)
disables (in effect, removes) the jitter attenuator. On-board circuitry adjusts either the recovered clock
from the clock/data recovery block or the clock applied at the TCLK pin to create a smooth jitter-free
clock that is used to clock data out of the jitter attenuator FIFO. It is acceptable to provide a
gapped/bursty clock at the TCLK pin if the jitter attenuator is placed on the transmit side. If the incoming
jitter exceeds either 120UIP-P (buffer depth is 128 bits) or 28UIP-P (buffer depth is 32 bits), then the
DS2155 divides the internal nominal 32.768MHz (E1) or 24.704MHz (T1) clock by either 15 or 17
instead of the normal 16 to keep the buffer from overflowing. When the device divides by either 15 or 17,
it also sets the jitter attenuator limit trip (JALT) bit in Status Register 1 (SR1.4).
24.6 CMI (Code Mark Inversion) Option
The DS2155 provides a CMI interface for connection to optical transports. This interface is a unipolar
1T2B signal type. Ones are encoded as either a logical 1 or 0 level for the full duration of the clock
period. Zeros are encoded as a 0-to-1 transition at the middle of the clock period.
Figure 24-2. CMI Coding
Transmit and receive CMI are enabled through LIC4.7. When this register bit is set, the TTIP pin outputs
CMI-coded data at normal levels. This signal can be used to directly drive an optical interface. When
CMI is enabled, the user can also use HDB3/B8ZS coding. When this register bit is set, the RTIP pin
becomes a unipolar CMI input. The CMI signal is processed to extract and align the clock with data.
0
1
11
00
1
CLOCK
DATA
CMI
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参数描述 |
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| DS2155LC2 | 功能描述:网络控制器与处理器 IC RoHS:否 制造商:Micrel 产品:Controller Area Network (CAN) 收发器数量: 数据速率: 电源电流（最大值）:595 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:PBGA-400 封装:Tray |
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