参数资料
型号: DS2187S
厂商: Maxim Integrated Products
文件页数: 8/10页
文件大小: 0K
描述: IC RECEIVE LINE INTERFACE 20SOIC
标准包装: 37
功能: 接收线路接口
接口: T1
电路数: 1
电源电压: 4.75 V ~ 5.25 V
电流 - 电源: 18mA
工作温度: 0°C ~ 70°C
安装类型: 表面贴装
封装/外壳: 20-SOIC(0.295",7.50mm 宽)
供应商设备封装: 20-SOIC W
包装: 管件
包括: AMI / B8ZS / HDB3 编码信号解码器
产品目录页面: 1429 (CN2011-ZH PDF)
DS2187
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ANALOG ELECTRICAL CHARACTERISTICS
(0
°C to 70°C; VDD = 5.0V ± 5%)
PARAMETER
SYMBOL
MIN
TYP
MAX
UNITS
NOTES
Clock Acquisition
tLOCK
50
ms
1
RTIP, RRING Minimum
Sensitivity
VTHRES
.4
.6
Vpk
2
FLL Loop Bandwidth
fBW
50
Hz
3
Capture Range
fCAP
± 6
%
4
Input Jitter Tolerance
JIN
200
UI
5
NOTES:
1. Time from reappearance of a valid signal at RPOS and RNEG to a LOCK=1.
2. Minimum peak voltage necessary for proper processing of signal.
3. Loop bandwidth when in lock (LOCK=1).
4. When out of lock (LOCK=0), measured as a percent of incoming clock frequency.
5. Maximum input jitter in unit intervals at 10 Hz.
CAPACITANCE
(TA = 25
°C)
PARAMETER
SYMBOL
MIN
TYP
MAX
UNITS
NOTES
Input Capacitance
CIN
5pF
Output Capacitance
COUT
7
pF
AC ELECTRICAL CHARACTERISTICS
(0
°C to 70°C; VDD = 5.0V ± 5%)
PARAMETER
SYMBOL
MIN
TYP
MAX
UNITS
NOTES
RCLK Period
tRCLK
594
648
702
ns
1,3
RCLK Period
tRCLK
445
488
530
ns
2,3
RCLK Pulse Width
tRWH,
tRWL
324
ns
1
RCLK Pulse Width
tRWH,
tRWL
244
ns
2
RCLK Rise and Fall Times
tR, tF
20
ns
Propagation delay RCLK TO
RPOS, RNEG
tPRD
75
ns
Propagation delay RCLK to
BPV, RCL, AIS
tPRA
75
ns
RAIS
Setup
tSU, tHD
50
ns
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