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参数资料
型号： DS26401A2+
厂商： Maxim Integrated Products
文件页数： 38/309页
文件大小： 0K
描述： IC OCTAL FRAMER T1/E1/J1 256BGA
产品培训模块： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
标准包装： 90
控制器类型： T1/E1/J1 调帧器
接口： WAN
电源电压： 3.135 V ~ 3.465 V
电流 - 电源： 275mA
工作温度： 0°C ~ 70°C
安装类型： 表面贴装
封装/外壳： 256-LBGA，CSBGA
供应商设备封装： 256-CSBGA（17x17）
包装： 托盘
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DS26401 Octal T1/E1/J1 Framer
132
9.16 Transmit SLC–96 Operation
In a SLC–96 based transmission scheme, the standard Fs bit pattern is robbed to make room for a set of message
fields. The SLC–96 multiframe is made up of six D4 superframes, hence it is 72 frames long. In the 72-frame SLC–
96 multiframe, 36 of the framing bits are the normal Ft pattern and the other 36 bits are divided into alarm,
maintenance, spoiler, and concentrator bits as well as 12 bits of the normal Fs pattern. Additional SLC-96
information can be found in BellCore document TR–TSY–000008.
To insert the SLC-96 message fields, the user has the option to either use the external TLINK pin or the use the
onboard TFDL register. Use of the TLINK pin will require additional circuitry, and to enable this option the TCR2.7
bit should be set to one. To insert the SLC-96 message using the TFDL register, the user should configure the
DS26401 as shown below:
TCR2.6 (TSLC96) = 1 Enable Transmit SLC-96
TCR2.7 (TFDLS) = 0
Source FS bits via TFDL or SLC96 formatter
TCR3.2 (TFM) = 1
D4 framing Mode
TCR1.6 (TFPT) = 0
Do not 'pass through' TSER F-bits.
The DS26401 will automatically insert the 12-bit alignment pattern in the Fs bits for the SLC96 data link frame.
Data from the TSLC1–TSLC3 will be inserted into the remaining Fs bit locations of the SLC96 multiframe. The
status bit TSLC96 located at TLS1.4 will set to indicate that the SLC96 data link buffer has been transmitted and
that the user should write new message data into TSLC1–TSLC3. The host will have 2.5ms after the assertion of
TLS1.4 to write the registers TSLC1–TSLC3. If no new data is provided in these registers, the previous values will
be retransmitted.
Register Name:
TSLC1, TSLC2, TSLC3
Register Description:
Transmit SLC96 Data Link Registers
Register Address:
164h, 165h, 166h [+ (200h x n) : where n = 0 to 7, for Ports 1 to 8]
(MSB)
(LSB)
C8
C7
C6
C5
C4
C3
C2
C1
TSLC1
M2
M1
S = 0
S = 1
S = 0
C11
C10
C9
TSLC2
S = 1
S4
S3
S2
S1
A2
A1
M3
TSLC3
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