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参数资料
| 型号： | DS3120 |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 82/133页 |
| 文件大小： | 0K |
| 描述： | IC FRAMER T1 28-CHAN 0-70C DEG |
| 标准包装： | 1 |
| 控制器类型： | T1 调帧器 |
| 接口： | 并行/串行 |
| 电源电压： | 2.97 V ~ 3.63 V |
| 电流 - 电源： | 300mA |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 316-BGA |
| 包装： | 管件 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页当前第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页
DS3112
52 of 133
Bits 5 and 6: Frame Bit Error Insert Control Bits 0 and 1 (FBEIC0 and FBEIC1).
FBEIC1
FBEIC0
TYPE OF FRAMING BIT ERROR INSERTED
0
T3 Mode: A single F-bit error
E3 Mode: A single FAS word of 1111000000 is generated instead of the normal FAS
word, which is 1111010000 (i.e., only 1 bit inverted)
0
1
T3 Mode: A single M-bit error
E3 Mode: A single FAS word of 0000101111 is generated instead of the normal FAS
word, which is 1111010000 (i.e., all FAS bits are inverted)
1
0
T3 Mode: Four consecutive F-bit errors (causes the far end to lose synchronization)
E3 Mode: Four consecutive FAS words of 1111000000 are generated instead of the
normal FAS word, which is 1111010000 (i.e., only 1 bit inverted; causes the far end
to lose synchronization)
1
T3 Mode: Three consecutive M-bit errors (causes the far end to lose synchronization)
E3 Mode: Four consecutive FAS words of 0000101111 are generated instead of the
normal FAS word, which is 1111010000 (i.e., all FAS bits are inverted; causes the far
end to lose synchronization)
Bit 7: Manual Error Insert Mode Select (MEIMS). When this bit is set low, the device will insert errors on each
0 to 1 transition of the BPVI, EXZI, T3PBEI, T3CPBEI, or FBEI control bits. When this bit is set high, the device
will insert errors on each 0 to 1 transition of the FTMEI input signal. The appropriate BPVI, EXZI, T3PBEI,
T3CPBEI, or FBEI control bit must be set to one for this to occur. If all of the BPVI, EXZI, T3PBEI, T3CPBEI,
and FBEI control bits are set to zero, no errors are inserted.
0 = use zero to one transition on the BPVI, EXZI, T3PBEI, T3CPBEI, or FBEI control bits to insert errors
1 = use zero to one transition on the FTMEI input signal to insert errors
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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