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参数资料
型号： DS3183N
厂商： Maxim Integrated Products
文件页数： 310/400页
文件大小： 0K
描述： IC TRPL ATM/PACKET PHY 400-PBGA
产品培训模块： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
标准包装： 1
类型： 调帧器
应用： 数据传输
安装类型： 表面贴装
封装/外壳： 400-BBGA
供应商设备封装： 400-PBGA（27x27）
包装： 管件
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页第201页第202页第203页第204页第205页第206页第207页第208页第209页第210页第211页第212页第213页第214页第215页第216页第217页第218页第219页第220页第221页第222页第223页第224页第225页第226页第227页第228页第229页第230页第231页第232页第233页第234页第235页第236页第237页第238页第239页第240页第241页第242页第243页第244页第245页第246页第247页第248页第249页第250页第251页第252页第253页第254页第255页第256页第257页第258页第259页第260页第261页第262页第263页第264页第265页第266页第267页第268页第269页第270页第271页第272页第273页第274页第275页第276页第277页第278页第279页第280页第281页第282页第283页第284页第285页第286页第287页第288页第289页第290页第291页第292页第293页第294页第295页第296页第297页第298页第299页第300页第301页第302页第303页第304页第305页第306页第307页第308页第309页当前第310页第311页第312页第313页第314页第315页第316页第317页第318页第319页第320页第321页第322页第323页第324页第325页第326页第327页第328页第329页第330页第331页第332页第333页第334页第335页第336页第337页第338页第339页第340页第341页第342页第343页第344页第345页第346页第347页第348页第349页第350页第351页第352页第353页第354页第355页第356页第357页第358页第359页第360页第361页第362页第363页第364页第365页第366页第367页第368页第369页第370页第371页第372页第373页第374页第375页第376页第377页第378页第379页第380页第381页第382页第383页第384页第385页第386页第387页第388页第389页第390页第391页第392页第393页第394页第395页第396页第397页第398页第399页第400页
DS3181/DS3182/DS3183/DS3184
378
Figure 14-2. DS3183 Pin Assignments—400-Lead TE-PBGA
Note: Green indicates VSS, Red indicates VDD, Yellow indicates system interface pins, and blank cells indicate no connect balls.
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
A
VSS
VDD
RPOS1 VDD_RX3
RXN3
TXN3
TSOFO1 TLCLK1
TPDENO
1
RPDAT3 RCLKO3 RLCLK3 TCLKO3
TCLKI3
RNEG3
TADR[1]
TPRTY
TADR[0]
TEN*
VSS
B MODE
ROHSOF
1
RNEG1
TCLKI1
RXP3
TXP3
TSOFI1
RLCLK1 TPDAT1
TPDENO
3
RSER3
RSOFO3 RPDENI3 TNEG3
RPOS3
RST*
TMOD[0] TMOD[1] TDATA[9]
VDD
C GPIO[5] GPIO[6]
A[10]
TPOS1 TPDENI1 VDD_JA3
TOHSOF
1
TOHCLK1 RPDAT1 TPDAT3 TLCLK3 TSOFO3
TSER3
TPOS3
TADR[4]
TDATA[21
]
TDATA[19
]
TDATA[20
]
TDATA[25
]
TDATA[8]
D VDD_RX1 A[5]
A[9]
TNEG1
ROHCLK
1
RPDENI1 TCLKO1
TOH1
RCLKO1
ROH1
TOH3
TSOFI3 TPDENI3
ROHSOF
3
TADR[3]
TDATA[22
]
TDATA[26
]
TDATA[27
]
TDXA[4] TDXA[2]
E
A[1]
A[4]
A[8]
JTRST* TOHEN1
TSER1 VDD_TX3 RSOFO1 RSER1
ROH3
TOHCLK3
TOHSOF
3
ROHCLK
3
TOHEN3 TADR[2]
TDATA[23
]
RDATA[2
7]
RDATA[2
0]
TDXA[3] RDXA[4]
F RXN1
RXP1
JTCLK
JTMS
GPIO[1]
VDD
VSS
VDD
RDATA[3
1]
RDATA[2
6]
RDXA[3] RDXA[2]
TDATA[24
]
G VDD_JA1 A[3]
A[7]
JTDO
GPIO[2]
VDD
VSS
VDD
RDATA[3
0]
RDATA[2
5]
REN*
RDATA[1
9]
RDATA[1
7]
H
A[0]
A[2]
A[6]
VDD
VSS
VDD
RDATA[2
9]
RDATA[2
4]
RDATA[2
2]
RDATA[1
8]
RDATA[1
6]
J TXN1
TXP1
JTDI
VDD_TX1
D[15]
VSS
RDATA[2
8]
RDATA[2
3]
RDATA[2
1]
RERR
TSCLK
K CLKA
RDY*
RD*
WR*
VDD_CLA
D
VSS
TSPA
TDXA[1]
RVAL
RDXA[1]
RPRTY
L CLKB
CLKC
CS*
INT*
WIDTH
VSS
REOP
RSOX
RMOD[0] RMOD[1] RDATA[0]
M TXN2
TXP2
TEST*
VSS
RDATA[1
5]
RDATA[1
1]
RDATA[2] RDATA[1] RSCLK
N VDD_TX2 ALE
D[6]
D[11]
VDD_JA2
VDD
VSS
VDD
RDATA[1
4]
RDATA[1
0]
RDATA[5] RDATA[4] RDATA[3]
P
D[0]
D[2]
D[7]
D[12]
GPIO[4]
VDD
VSS
VDD
RDATA[1
3]
RDATA[9] RDATA[8] RDATA[7] RDATA[6]
R RXN2
RXP2
HIZ*
D[13]
GPIO[3]
VDD
VSS
VDD
RDATA[1
2]
TDATA[16
]
RADR[2] RADR[1] RADR[0]
T VDD_RX2 D[3]
D[8]
D[14]
TOHEN2
TSER2
RSOFO2 RSER2
TDATA[30
]
TDATA[17
]
TDATA[18
]
TDATA[1] RADR[4] RADR[3]
U
D[1]
D[4]
D[9]
TNEG2
ROHCLK
2
RPDENI2 TCLKO2
TOH2
RCLKO2
ROH2
TDATA[31
]
TDATA[29
]
TDATA[28
]
TDATA[6] TDATA[3] TDATA[0]
V GPIO[7] GPIO[8]
D[10]
TPOS2 TPDENI2
TOHSOF
2
TOHCLK2 RPDAT2
TEOP
TDATA[15
]
TDATA[12
]
TDATA[5] TDATA[4] TDATA[2]
W
VDD
D[5]
RNEG2
TCLKI2
TSOFI2
RLCLK2 TPDAT2
TSOX
TDATA[14
]
TDATA[11
]
TDATA[10
]
TDATA[7]
Y
VSS
ROHSOF
2
RPOS2
TSOFO2 TLCLK2
TPDENO
2
TSX
TERR
TDATA[13
]
VDD
VSS
Figure 14-3. DS3182 Pin Assignments—400-Lead TE-PBGA
Note: Green indicates VSS, Red indicates VDD, Yellow indicates system interface pins, and blank cells indicate no connect balls.
123456789
10
11
12
13
14
15
16
17
18
19
20
A VSS
VDD
RPOS1
TSOFO1
TLCLK1
TPDENO
1
TADR[1]
TPRTY
TADR[0]
TEN*
VSS
B MODE
ROHSOF
1
RNEG1
TCLKI1
TSOFI1
RLCLK1
TPDAT1
RST*
TMOD[0] TMOD[1] TDATA[9]
VDD
C GPIO[5] GPIO[6]
A[10]
TPOS1
TPDENI1
TOHSOF
1
TOHCLK1 RPDAT1
TADR[4]
TDATA[21
]
TDATA[19
]
TDATA[20
]
TDATA[25
]TDATA[8]
D VDD_RX1 A[5]
A[9]
TNEG1
ROHCLK
1
RPDENI1 TCLKO1
TOH1
RCLKO1
ROH1
TADR[3]
TDATA[22
]
TDATA[26
]
TDATA[27
]TDXA[4]
TDXA[2]
E
A[1]
A[4]
A[8]
JTRST*
TOHEN1
TSER1
RSOFO1
RSER1
TADR[2]
TDATA[23
]
RDATA[2
7]
RDATA[2
0]
TDXA[3]
RDXA[4]
F RXN1
RXP1
JTCLK
JTMS
GPIO[1]
VDD
VSS
VDD
RDATA[3
1]
RDATA[2
6]
RDXA[3]
RDXA[2]
TDATA[24
]
G VDD_JA1
A[3]
A[7]
JTDO
GPIO[2]
VDD
VSS
VDD
RDATA[3
0]
RDATA[2
5]
REN*
RDATA[1
9]
RDATA[1
7]
H
A[0]
A[2]
A[6]
VDD
VSS
VDD
RDATA[2
9]
RDATA[2
4]
RDATA[2
2]
RDATA[1
8]
RDATA[1
6]
J TXN1
TXP1
JTDI
VDD_TX1
D[15]
VSS
RDATA[2
8]
RDATA[2
3]
RDATA[2
1]
RERR
TSCLK
K CLKA
RDY*
RD*
WR*
VDD_CLA
D
VSS
TSPA
TDXA[1]
RVAL
RDXA[1]
RPRTY
L CLKB
CLKC
CS*
INT*
WIDTH
VSS
REOP
RSOX
RMOD[0] RMOD[1] RDATA[0]
M TXN2
TXP2
TEST*
VSS
RDATA[1
5]
RDATA[1
1]
RDATA[2] RDATA[1] RSCLK
N VDD_TX2 ALE
D[6]
D[11]
VDD_JA2
VDD
VSS
VDD
RDATA[1
4]
RDATA[1
0]
RDATA[5] RDATA[4] RDATA[3]
P
D[0]
D[2]
D[7]
D[12]
GPIO[4]
VDD
VSS
VDD
RDATA[1
3]
RDATA[9] RDATA[8] RDATA[7] RDATA[6]
R RXN2
RXP2
HIZ*
D[13]
GPIO[3]
VDD
VSS
VDD
RDATA[1
2]
TDATA[16
]
RADR[2] RADR[1] RADR[0]
T VDD_RX2 D[3]
D[8]
D[14]
TOHEN2
TSER2
RSOFO2
RSER2
TDATA[30
]
TDATA[17
]
TDATA[18
]
TDATA[1] RADR[4] RADR[3]
U
D[1]
D[4]
D[9]
TNEG2
ROHCLK
2
RPDENI2 TCLKO2
TOH2
RCLKO2
ROH2
TDATA[31
]
TDATA[29
]
TDATA[28
]
TDATA[6] TDATA[3] TDATA[0]
V GPIO[7] GPIO[8]
D[10]
TPOS2
TPDENI2
TOHSOF
2
TOHCLK2 RPDAT2
TEOP
TDATA[15
]
TDATA[12
]
TDATA[5] TDATA[4] TDATA[2]
W VDD
D[5]
RNEG2
TCLKI2
TSOFI2
RLCLK2
TPDAT2
TSOX
TDATA[14
]
TDATA[11
]
TDATA[10
]TDATA[7]
Y
VSS
ROHSOF
2
RPOS2
TSOFO2
TLCLK2
TPDENO
2
TSX
TERR
TDATA[13
]
VDD
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