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参数资料
| 型号： | DS72613RB120FPV |
| 厂商： | Renesas Electronics America |
| 文件页数： | 10/226页 |
| 文件大小： | 0K |
| 描述： | IC SUPERH MPU ROMLESS 176LQFP |
| 产品培训模块： | CAN Basics Part-1 CAN Basics Part-2 Electromagnetic Noise Reduction Techniques Part 1 |
| 标准包装： | 1 |
| 系列： | SuperH® SH7200 |
| 核心处理器： | SH-2A |
| 芯体尺寸： | 32-位 |
| 速度： | 120MHz |
| 连通性： | CAN，EBI/EMI，FIFO，I²C，IEBus，SCI，串行声控 |
| 外围设备： | DMA，POR，PWM，WDT |
| 输入/输出数： | 104 |
| 程序存储器类型： | ROMless |
| RAM 容量： | 32K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 数据转换器： | A/D 8x10b; D/A 2x8b |
| 振荡器型： | 外部 |
| 工作温度： | -20°C ~ 70°C |
| 封装/外壳： | 176-LQFP |
| 包装： | 托盘 |
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8006K–AVR–10/10
ATtiny24/44/84
Table 14-2 shows the relationship between the USICS1:0 and USICLK setting and clock source
used for the USI Data Register and the 4-bit counter.
Bit 1 – USICLK: Clock Strobe
Writing a one to this bit location strobes the USI Data Register to shift one step and the counter
to increment by one, provided that the software clock strobe option has been selected by writing
USICS1:0 bits to zero. The output will change immediately when the clock strobe is executed,
i.e., during the same instruction cycle. The value shifted into the USI Data Register is sampled
the previous instruction cycle.
When an external clock source is selected (USICS1 = 1), the USICLK function is changed from
a clock strobe to a Clock Select Register. Setting the USICLK bit in this case will select the
USITC strobe bit as clock source for the 4-bit counter (see Table 14-2).
The bit will be read as zero.
Bit 0 – USITC: Toggle Clock Port Pin
Writing a one to this bit location toggles the USCK/SCL value either from 0 to 1, or from 1 to 0.
The toggling is independent of the setting in the Data Direction Register, but if the PORT value is
to be shown on the pin the corresponding DDR pin must be set as output (to one). This feature
allows easy clock generation when implementing master devices.
When an external clock source is selected (USICS1 = 1) and the USICLK bit is set to one, writ-
ing to the USITC strobe bit will directly clock the 4-bit counter. This allows an early detection of
when the transfer is done when operating as a master device.
The bit will read as zero.
Table 14-2.
Relationship between the USICS1:0 and USICLK Setting
USICS1
USICS0
USICLK
Clock Source
4-bit Counter Clock Source
0
No Clock
0
1
Software clock strobe (USICLK)
0
1
X
Timer/Counter0 Compare Match
1
0
External, positive edge
External, both edges
1
0
External, negative edge
External, both edges
1
0
1
External, positive edge
Software clock strobe (USITC)
1
External, negative edge
Software clock strobe (USITC)
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参数描述 |
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