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参数资料
| 型号： | DS80C323-QCD |
| 厂商： | DALLAS SEMICONDUCTOR |
| 元件分类： | Microcontroller |
| 英文描述： | 8-BIT, MROM, 18 MHz, MICROCONTROLLER, PQCC44 |
| 封装： | PLASTIC, LCC-44 |
| 文件页数： | 25/42页 |
| 文件大小： | 687K |
| 代理商： | DS80C323-QCD |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页当前第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页
DS80C320/DS80C323
31 of 42
DS80C320/DS80C323 EXTERNAL CLOCK CHARACTERISTICS
PARAMETER
SYMBOL
MIN
TYP
MAX
UNITS
NOTES
Clock High Time
tCHCX
10
ns
Clock Low Time
tCLCX
10
ns
Clock Rise Time
tCLCH
5
ns
Clock Fall Time
tCHCL
5
ns
DS80C320/DS80C323 SERIAL PORT MODE 0 TIMING CHARACTERISTICS
PARAMETER
SYMBOL
MIN
TYP
MAX
UNITS
NOTES
Serial Port Clock Cycle Time
SM2=0 12 clocks per cycle
SM2=1 4 clocks per cycle
tXLXL
12tCLCL
4tCLCL
ns
Output Data Setup to Clock
Rising Edge
SM2=0 12 clocks per cycle
SM2=1 4 clocks per cycle
tQVXH
10tCLCL
3tCLCL
ns
Output Data Hold from Clock
Rising
SM2=0 12 clocks per cycle
SM2=1 4 clocks per cycle
tXHQX
2tCLCL
tCLCL
ns
Input Data Hold after Clock
Rising
SM2=0 12 clocks per cycle
SM2=1 4 clocks per cycle
tXHDX
tCLCL
ns
Clock Rising Edge to Input
Data Valid
SM2=0 12 clocks per cycle
SM2=1 4 clocks per cycle
tXHDV
11tCLCL
2tCLCL
ns
EXPLANATION OF AC SYMBOLS
In an effort to remain compatible with the original 8051 family, this device specifies the same parameter
as such devices, using the same symbols. For completeness, the following is an explanation of the
symbols.
t
Time
A
Address
C
Clock
D
Input data
H
Logic level high
L
Logic level low
I
Instruction
P
PSEN
Q
Output data
R
RD
signal
V
Valid
W
WR
signal
X
No longer a valid logic level
Z
Tristate
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PDF描述 |
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| DS80C390-QNR | 8-BIT, 40 MHz, MICROCONTROLLER, PQCC68 |
| DS80C390-FNR | 8-BIT, 40 MHz, MICROCONTROLLER, PQFP64 |
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