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参数资料
| 型号： | DSPIC30F3012-30I/P |
| 厂商： | Microchip Technology |
| 文件页数： | 141/161页 |
| 文件大小： | 0K |
| 描述： | IC DSPIC MCU/DSP 24K 18DIP |
| 产品培训模块： | Serial Communications using dsPIC30F I2C Serial Communications using dsPIC30F SPI Serial Communications using dsPIC30F UART dsPIC30F 12 bit ADC - Part 2 dsPIC30F Addressing Modes - Part 1 dsPIC30F Architecture - Part 1 dsPIC30F DSP Engine & ALU dsPIC30F Interrupts dsPIC30F Motor Control PWM dsPIC Timers Asynchronous Stimulus dsPIC30F Addressing Modes - Part 2 dsPIC30F Architecture - Part 2 dsPIC30F 12-bit ADC Part 1 |
| 标准包装： | 25 |
| 系列： | dsPIC™ 30F |
| 核心处理器： | dsPIC |
| 芯体尺寸： | 16-位 |
| 速度： | 30 MIP |
| 连通性： | I²C，SPI，UART/USART |
| 外围设备： | 欠压检测/复位，POR，PWM，WDT |
| 输入/输出数： | 12 |
| 程序存储器容量： | 24KB（8K x 24） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 1K x 8 |
| RAM 容量： | 2K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.5 V ~ 5.5 V |
| 数据转换器： | A/D 8x12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 18-DIP（0.300"，7.62mm） |
| 包装： | 管件 |
| 产品目录页面： | 651 (CN2011-ZH PDF) |
| 配用： | AC30F005-ND - MODULE SCKT DSPIC30F 18DIP/SOIC DV164005-ND - KIT ICD2 SIMPLE SUIT W/USB CABLE ACICE0202-ND - ADAPTER MPLABICE 18P 300 MIL |
| 其它名称： | DSPIC30F3012-30IP |
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dsPIC30F2011/2012/3012/3013
DS70139G-page 66
2010 Microchip Technology Inc.
8.1
Interrupt Priority
The user-assignable interrupt priority bits (IP<2:0>) for
each individual interrupt source are located in the
LS 3 bits of each nibble within the IPCx register(s). Bit
3 of each nibble is not used and is read as a ‘0’. These
bits define the priority level assigned to a particular
interrupt by the user.
Natural Order Priority is determined by the position of
an interrupt in the vector table, and only affects
interrupt operation when multiple interrupts with the
same user-assigned priority become pending at the
same time.
Table 8-1 lists the interrupt numbers and interrupt
sources
for
the
dsPIC30F2011/2012/3012/3013
devices and their associated vector numbers.
The ability for the user to assign every interrupt to one
of seven priority levels means that the user can assign
a very high overall priority level to an interrupt with a
low natural order priority. For example, the PLVD
(Low Voltage Detect) can be given a priority of 7. The
INT0 (External Interrupt 0) may be assigned to priority
level 1, thus giving it a very low effective priority.
TABLE 8-1:
INTERRUPT VECTOR TABLE
Note:
The user-assignable priority levels start at
0 as the lowest priority and level 7 as the
highest priority.
Note 1: The natural order priority scheme has 0
as the highest priority and 53 as the
lowest priority.
2: The natural order priority number is the
same as the INT number.
Interrupt
Number
Vector
Number
Interrupt Source
Highest Natural Order Priority
0
8
INT0 – External Interrupt 0
1
9
IC1 – Input Capture 1
2
10
OC1 – Output Compare 1
3
11
T1 – Timer 1
4
12
IC2 – Input Capture 2
5
13
OC2 – Output Compare 2
6
14
T2 – Timer2
7
15
T3 – Timer3
816
SPI1
9
17
U1RX – UART1 Receiver
10
18
U1TX – UART1 Transmitter
11
19
ADC – ADC Convert Done
12
20
NVM – NVM Write Complete
13
21
SI2C – I2C Slave Interrupt
14
22
MI2C – I2C Master Interrupt
15
23
Input Change Interrupt
16
24
INT1 – External Interrupt 1
17-22
25-30
Reserved
23
31
INT2 – External Interrupt 2
24
32
U2RX(1) – UART2 Receiver
25
33
U2TX(1) – UART2 Transmitter
26-41
34-49
Reserved
42
50
LVD – Low-Voltage Detect
43-53
51-61
Reserved
Lowest Natural Order Priority
Note 1:
Only the dsPIC30F3013 has UART2 and
the U2RX, U2TX interrupts. These
locations are reserved for the
dsPIC30F2011/2012/3012.
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