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参数资料
| 型号： | DSPIC30F3014-30I/PT |
| 厂商： | Microchip Technology |
| 文件页数： | 30/153页 |
| 文件大小： | 0K |
| 描述： | IC DSPIC MCU/DSP 24K 44TQFP |
| 产品培训模块： | Serial Communications using dsPIC30F I2C Serial Communications using dsPIC30F SPI Serial Communications using dsPIC30F UART dsPIC30F 12 bit ADC - Part 2 dsPIC30F Addressing Modes - Part 1 dsPIC30F Architecture - Part 1 dsPIC30F DSP Engine & ALU dsPIC30F Interrupts dsPIC30F Motor Control PWM dsPIC Timers Asynchronous Stimulus dsPIC30F Addressing Modes - Part 2 dsPIC30F Architecture - Part 2 dsPIC30F 12-bit ADC Part 1 |
| 标准包装： | 160 |
| 系列： | dsPIC™ 30F |
| 核心处理器： | dsPIC |
| 芯体尺寸： | 16-位 |
| 速度： | 30 MIP |
| 连通性： | I²C，SPI，UART/USART |
| 外围设备： | 欠压检测/复位，POR，PWM，WDT |
| 输入/输出数： | 30 |
| 程序存储器容量： | 24KB（8K x 24） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 1K x 8 |
| RAM 容量： | 2K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.5 V ~ 5.5 V |
| 数据转换器： | A/D 13x12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 44-TQFP |
| 包装： | 托盘 |
| 产品目录页面： | 651 (CN2011-ZH PDF) |
| 配用： | XLT80PT3-ND - SOCKET TRAN ICE 80MQFP/TQFP AC164305-ND - MODULE SKT FOR PM3 44TQFP DV164005-ND - KIT ICD2 SIMPLE SUIT W/USB CABLE |
| 其它名称： | DSPIC30F301430IPT |
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2010 Microchip Technology Inc.
DS70138G-page 125
dsPIC30F3014/4013
18.3.7
BIT CLOCK GENERATOR
The DCI module has a dedicated 12-bit time base that
produces the bit clock. The bit clock rate (period) is set
by writing a non-zero 12-bit value to the BCG<11:0>
control bits in the DCICON3 SFR.
When the BCG<11:0> bits are set to zero, the bit clock
is disabled. If the BCG<11:0> bits are set to a non-zero
value, the bit clock generator is enabled. These bits
should be set to ‘0’ and the CSCKD bit set to ‘1’ if the
serial clock for the DCI is received from an external
device.
The formula for the bit clock frequency is given in
EQUATION 18-2:
BIT CLOCK FREQUENCY
The required bit clock frequency is determined by the
system sampling rate and frame size. Typical bit clock
frequencies range from 16x to 512x the converter
sample rate depending on the data converter and the
communication protocol that is used.
To achieve bit clock frequencies associated with
common audio sampling rates, the user needs to select
a crystal frequency that has an ‘even’ binary value.
Examples of such crystal frequencies are listed in
TABLE 18-1:
DEVICE FREQUENCIES FOR COMMON CODEC CSCK FREQUENCIES
FBCK =
FCY
2
(BCG + 1)
FS (kHz)
FCSCK/FS
FCSCK (MHz)(1)
FOSC (MHZ)PLL
FCY (MIPS)
BCG(2)
8
256
2.048
8.192
4
8.192
1
12
256
3.072
6.144
8
12.288
1
32
1.024
8.192
8
16.384
7
44.1
32
1.4112
5.6448
8
11.2896
3
48
64
3.072
6.144
16
24.576
3
Note 1:
When the CSCK signal is applied externally (CSCKD = 1), the BCG<11:0> bits have no effect on the
operation of the DCI module.
2:
When the CSCK signal is applied externally (CSCKD = 1), the external clock high and low times must
meet the device timing requirements.
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