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参数资料
| 型号： | DSPIC30F5011T-20E/PT |
| 厂商： | Microchip Technology |
| 文件页数： | 151/220页 |
| 文件大小： | 0K |
| 描述： | IC DSPIC MCU/DSP 66K 64TQFP |
| 产品培训模块： | Asynchronous Stimulus |
| 标准包装： | 1,200 |
| 系列： | dsPIC™ 30F |
| 核心处理器： | dsPIC |
| 芯体尺寸： | 16-位 |
| 速度： | 20 MIPS |
| 连通性： | CAN，I²C，SPI，UART/USART |
| 外围设备： | AC'97，欠压检测/复位，I²S，LVD，POR，PWM，WDT |
| 输入/输出数： | 52 |
| 程序存储器容量： | 66KB（22K x 24） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 1K x 8 |
| RAM 容量： | 4K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.5 V ~ 5.5 V |
| 数据转换器： | A/D 16x12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 125°C |
| 封装/外壳： | 64-TQFP |
| 包装： | 带卷 (TR) |
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dsPIC30F5011/5013
DS70116J-page 36
2011 Microchip Technology Inc.
4.1
Interrupt Priority
The user-assignable interrupt priority (IP<2:0>) bits for
each individual interrupt source are located in the Least
Significant 3 bits of each nibble within the IPCx regis-
ter(s). Bit 3 of each nibble is not used and is read as a
‘0’. These bits define the priority level assigned to a
particular interrupt by the user.
Since more than one interrupt request source may be
assigned to a specific user-assigned priority level, a
means is provided to assign priority within a given level.
This method is called “Natural Order Priority” and is
final.
Natural order priority is determined by the position of an
interrupt in the vector table, and only affects interrupt
operation when multiple interrupts with the same user-
assigned priority become pending at the same time.
Table 4-1 lists the interrupt numbers and interrupt
sources for the dsPIC DSC device and their associated
vector numbers.
The ability for the user to assign every interrupt to one
of seven priority levels implies that the user can assign
a very high overall priority level to an interrupt with a
low natural order priority. For example, the PLVD (Low-
Voltage Detect) can be given a priority of 7. The INT0
(External Interrupt 0) may be assigned to priority level
1, thus giving it a very low effective priority.
TABLE 4-1:
INTERRUPT VECTOR TABLE
Note:
The user-assignable priority levels start at
0 as the lowest priority and level 7 as the
highest priority.
Note 1: The natural order priority scheme has 0
as the highest priority and 53 as the
lowest priority.
2: The natural order priority number is the
same as the INT number.
INT
Number
Vector
Number
Interrupt Source
Highest Natural Order Priority
0
8
INT0 – External Interrupt 0
1
9
IC1 – Input Capture 1
2
10
OC1 – Output Compare 1
3
11
T1 – Timer1
4
12
IC2 – Input Capture 2
5
13
OC2 – Output Compare 2
6
14
T2 – Timer2
7
15
T3 – Timer3
816
SPI1
9
17
U1RX – UART1 Receiver
10
18
U1TX – UART1 Transmitter
11
19
ADC – ADC Convert Done
12
20
NVM – NVM Write Complete
13
21
SI2C – I2C Slave Interrupt
14
22
MI2C – I2C Master Interrupt
15
23
Input Change Interrupt
16
24
INT1 – External Interrupt 1
17
25
IC7 – Input Capture 7
18
26
IC8 – Input Capture 8
19
27
OC3 – Output Compare 3
20
28
OC4 – Output Compare 4
21
29
T4 – Timer4
22
30
T5 – Timer5
23
31
INT2 – External Interrupt 2
24
32
U2RX – UART2 Receiver
25
33
U2TX – UART2 Transmitter
26
34
SPI2
27
35
C1 – Combined IRQ for CAN1
28
36
IC3 – Input Capture 3
29
37
IC4 – Input Capture 4
30
38
IC5 – Input Capture 5
31
39
IC6 – Input Capture 6
32
40
OC5 – Output Compare 5
33
41
OC6 – Output Compare 6
34
42
OC7 – Output Compare 7
35
43
OC8 – Output Compare 8
36
44
INT3 – External Interrupt 3
37
45
INT4 – External Interrupt 4
38
46
C2 – Combined IRQ for CAN2
39-40
47-48
Reserved
41
49
DCI – Codec Transfer Done
42
50
LVD – Low-Voltage Detect
43-53
51-61
Reserved
Lowest Natural Order Priority
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参数描述 |
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