参数资料
型号: DSPIC33FJ12GP201-I/SO
厂商: Microchip Technology
文件页数: 31/90页
文件大小: 0K
描述: IC DSPIC MCU/DSP 12K 18SOIC
产品培训模块: Asynchronous Stimulus
特色产品: PIC24FJ/33FJ MCUs & dsPIC? DSCs
标准包装: 42
系列: dsPIC™ 33F
核心处理器: dsPIC
芯体尺寸: 16-位
速度: 40 MIP
连通性: I²C,IrDA,SPI,UART/USART
外围设备: 欠压检测/复位,POR,PWM,WDT
输入/输出数: 13
程序存储器容量: 12KB(12K x 8)
程序存储器类型: 闪存
RAM 容量: 1K x 8
电压 - 电源 (Vcc/Vdd): 3 V ~ 3.6 V
数据转换器: A/D 6x12b
振荡器型: 内部
工作温度: -40°C ~ 85°C
封装/外壳: 18-SOIC(0.295",7.50mm 宽)
包装: 管件
产品目录页面: 651 (CN2011-ZH PDF)
配用: AC164339-ND - MODULE SKT FOR PM3 28SOIC
DM240001-ND - BOARD DEMO PIC24/DSPIC33/PIC32
2005 Microchip Technology Inc.
Preliminary
DS70155C-page 35
dsPIC33F
TABLE 9-4:
MATH INSTRUCTIONS
Assembly
Syntax
Description
Words
Cycles
ADD
f {,WREG}
Destination = f + WREG
1
ADD
#lit10,Wn
Wn = lit10 + Wn
1
ADD
Wb,#lit5,Wd
Wd = Wb + lit5
1
ADD
Wb,Ws,Wd
Wd = Wb + Ws
1
ADDC
f {,WREG}
Destination = f + WREG + (C)
1
ADDC
#lit10,Wn
Wn = lit10 + Wn + (C)
1
ADDC
Wb,#lit5,Wd
Wd = Wb + lit5 + (C)
1
ADDC
Wb,Ws,Wd
Wd = Wb + Ws + (C)
1
DAW.B
Wn
Wn = decimal adjust Wn
1
DEC
f {,WREG}
Destination = f – 1
1
DEC
Ws,Wd
Wd = Ws – 1
1
DEC2
f {,WREG}
Destination = f – 2
1
DEC2
Ws,Wd
Wd = Ws – 2
1
DIV.S
Wm,Wn
Signed 16/16-bit integer divide*
118
DIV.SD
Wm,Wn
Signed 32/16-bit integer divide*
118
DIV.U
Wm,Wn
Unsigned 16/16-bit integer divide*
118
DIV.UD
Wm,Wn
Unsigned 32/16-bit integer divide*
118
DIVF
Wm,Wn
Signed 16/16-bit fractional divide*
118
INC
f {,WREG}
Destination = f + 1
1
INC
Ws,Wd
Wd = Ws + 1
1
INC2
f {,WREG}
Destination = f + 2
1
INC2
Ws,Wd
Wd = Ws + 2
1
MUL
f
W3:W2 = f * WREG
1
MUL.SS
Wb,Ws,Wnd
{Wnd + 1,Wnd} = sign(Wb) * sign(Ws)
1
MUL.SU
Wb,#lit5,Wnd
{Wnd + 1,Wnd} = sign(Wb) * unsign(lit5)
1
MUL.SU
Wb,Ws,Wnd
{Wnd + 1,Wnd} = sign(Wb) * unsign(Ws)
1
MUL.US
Wb,Ws,Wnd
{Wnd + 1,Wnd} = unsign(Wb) * sign(Ws)
1
MUL.UU
Wb,#lit5,Wnd
{Wnd + 1,Wnd} = unsign(Wb) * unsign(lit5)
1
MUL.UU
Wb,Ws,Wnd
{Wnd + 1,Wnd} = unsign(Wb) * unsign(Ws)
1
SE
Ws,Wnd
Wnd = sign-extended Ws
1
SUB
f {,WREG}
Destination = f – WREG
1
SUB
#lit10, Wn
Wn = Wn – lit10
1
SUB
Wb,#lit5,Wd
Wd = Wb – lit5
1
SUB
Wb,Ws,Wd
Wd = Wb – Ws
1
SUBB
f {,WREG}
Destination = f – WREG – (C)
1
SUBB
#lit10, Wn
Wn = Wn – lit10 – (C)
1
SUBB
Wb,#lit5,Wd
Wd = Wb – lit5 – (C)1
1
SUBB
Wb,Ws,Wd
Wd = Wb – Ws – (C)1
1
SUBBR
f {,WREG}
Destination = WREG – f – (C)1
1
SUBBR
Wb,#lit5,Wd
Wd = lit5 – Wb – (C)1
1
SUBBR
Wb,Ws,Wd
Wd = Ws – Wb – (C)1
1
SUBR
f {,WREG}
Destination = WREG – f
1
SUBR
Wb,#lit5,Wd
Wd = lit5 – Wb
1
SUBR
Wb,Ws,Wd
Wd = Ws – Wb
1
ZE
Ws,Wnd
Wnd = zero-extended Ws
1
* Divide instructions are interruptible on a cycle-by-cycle basis. Also, divide instructions must be accompanied by a
REPEAT
instruction, which adds 1 extra cycle.
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