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参数资料
| 型号： | EDI8F82048C |
| 英文描述： | 2 Megabits x 8 Static RAM CMOS, Module(2Mx8 CMOS静态RAM模块) |
| 中文描述： | 2兆位× 8静态RAM的CMOS模块（2Mx8的CMOS静态内存模块） |
| 文件页数： | 3/6页 |
| 文件大小： | 162K |
| 代理商： | EDI8F82048C |
EDI8F82048C
2 Megx8 SRAM Module
3
EDI8F82048C Rev. 4.0 4/96 ECO#7470
AC Characteristics Read Cycle
Symbol
70ns
85ns
100ns
Parameter
JEDEC
Alt.
Min
Max
Min
Max
Min
Max
Units
Read Cycle 1 - W High, G, E Low
TAVAV
TAVQV
TAVQX
DATA 2
A
Q
ADDRESS 1
ADDRESS 2
DATA 1
TGHQZ
TELQV
TELQX
E
G
Q
TEHQZ
A
TAVAV
TGLQV
TGLQX
TAVQV
Read Cycle 2 - W High
Read Cycle Time
TAVAV
TRC
70
85
100
ns
Address Access Time
TAVQV
TAA
70
85
100
ns
Chip Enable Access Time
TELQV
TACS
70
85
100
ns
Chip Enable to Output in Low Z (1)
TELQX
TCLZ
5
ns
Chip Disable to Output in High Z (1)
TEHQZ
TCHZ
30
35
40
ns
Output Hold from Address Change
TAVQX
TOH
3
ns
Output Enable to Output Valid
TGLQV
TOE
40
45
50
ns
Output Enable to Output in Low Z (1)
TGLQX
TOLZ
0
ns
Output Disable to Output in High Z (1)
TGHQZ
TOHZ
30
35
40
ns
Note 1: Parameter guaranteed, but not tested.
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PDF描述 |
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参数描述 |
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