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参数资料
| 型号： | EF-ISE-DSP-NL |
| 厂商： | Xilinx Inc |
| 文件页数： | 22/83页 |
| 文件大小： | 0K |
| 描述： | SOFTWARE ISE DSP EDITION |
| 标准包装： | 1 |
| 系列： | ISE® 设计套件 |
| 类型： | 集成软件环境（ISE） |
| 适用于相关产品： | Xilinx DSPs |
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Chapter 2: Installation
Note: If installation instructions for your particular platform are not provided here, please refer to the
installation instuctions that come with your Platform Kit. For instructions on how to install a Xilinx USB
Cable and cable driver software on a Windows or Linux Operating System, refer to the Xilinx
document titled: USB Cable Installation Guide
JTAG-Based Hardware Co-Simulation
Third-Party Hardware Co-Simulation
As part of the Xilinx XtremeDSP? Initiative, Xilinx works with distributors and many
OEMs to provide a variety of DSP prototyping and development platforms. Please refer to
the following Xilinx web site page for more information on available platforms:
Compiling Xilinx HDL Libraries
If you intend to simulate System Generator designs using ModelSim, you must compile
your IP (cores) libraries. This topic describes the procedure.
ModelSim SE
The Xilinx tool that compiles libraries for use in ModelSim SE is named compxlib . The
following command can, for example, be used to compile all the VHDL and Verilog
libraries with ModelSim SE:
compxlib –s mti_se –f all –l all
Complete instructions for running compxlib can be found in the ISE Software Manual
titled “Command Line Tool User Guide”.
Configuring the System Generator Cache
Both the System Generator simulator and the design generator incorporate a disk cache to
speed up the iterative design process. The cache does this by tagging and storing files
related to simulation and generation, then recalling those files during subsequent
simulation and generation rather than rerunning the time consuming tools used to create
those files.
Setting the Size
By default, the cache will use up to 500 MB of disk space to store files. To specify the
amount of disk space the cache should use, set the SYSGEN_CACHE_SIZE environment
variable to the size of the cache in megabytes. Set this number to a higher value when
working on several large designs.
Setting the Number of Entries
The cache entry database stores a fixed number of entries. The default is 20,000 entries. To
set size of the cache entry database, set the SYSGEN_CACHE_ENTRIES environment
22
System Generator for DSP Getting Started Guide
UG639 (v 13.1) March 1, 2011
相关PDF资料 |
PDF描述 |
|---|---|
| ECE-V2AA100UP | CAP ALUM 10UF 100V 20% SMD |
| VE-JVP-EZ-F1 | CONVERTER MOD DC/DC 13.8V 25W |
| EF-ISE-LOG-FL | DESIGN SUITE LOGIC EDITION |
| VE-JVN-EZ-F4 | CONVERTER MOD DC/DC 18.5V 25W |
| VE-JVM-EZ-F2 | CONVERTER MOD DC/DC 10V 25W |
相关代理商/技术参数 |
参数描述 |
|---|---|
| EF-ISE-EMBD-FL | 功能描述:SOFTWARE ISE EMBD RoHS:是 类别:编程器，开发系统 >> 软件 系列:ISE® 设计套件 标准包装:1 系列:ISE® 设计套件 类型:订阅 适用于相关产品:Xilinx FPGAs 其它名称:Q4986209T1081384 |
| EF-ISE-EMBD-NL | 功能描述:SOFTWARE ISE EMBD RoHS:是 类别:编程器，开发系统 >> 软件 系列:ISE® 设计套件 标准包装:1 系列:ISE® 设计套件 类型:订阅 适用于相关产品:Xilinx FPGAs 其它名称:Q4986209T1081384 |
| EF-ISE-LOG-FL | 功能描述:DESIGN SUITE LOGIC EDITION RoHS:是 类别:编程器，开发系统 >> 软件 系列:ISE® 设计套件 标准包装:1 系列:ISE® 设计套件 类型:订阅 适用于相关产品:Xilinx FPGAs 其它名称:Q4986209T1081384 |
| EF-ISE-LOG-NL | 功能描述:DESIGN SUITE LOGIC EDITION ISE12 RoHS:是 类别:编程器，开发系统 >> 软件 系列:ISE® 设计套件 标准包装:1 系列:ISE® 设计套件 类型:订阅 适用于相关产品:Xilinx FPGAs 其它名称:Q4986209T1081384 |
| EF-ISE-SYSTEM-FL | 功能描述:ISE DESIGN SYST FLOATING LICENSE RoHS:是 类别:编程器，开发系统 >> 软件 系列:ISE® 设计套件 标准包装:1 系列:ISE® 设计套件 类型:订阅 适用于相关产品:Xilinx FPGAs 其它名称:Q4986209T1081384 |
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