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参数资料
| 型号： | EFM32-TG110F32-SK |
| 厂商： | Energy Micro |
| 文件页数： | 94/136页 |
| 文件大小： | 0K |
| 描述： | IC MICRO KIT GECKO 24QFN |
| 标准包装： | 1 |
| 系列： | Tiny Gecko |
| 套件类型： | 微控制器 |
| 值： | 2 件 - 闪存 - 32KB |
| 包装： | 纸板盒 |
| 安装类型： | 表面贴装 |
| 包括封装： | 24-QFN |
| 工具箱内容： | (2) 914-1033-2-ND - MCU 32BIT 32KB FLASH 24-QFN |
| 其它名称： | 914-1022 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页当前第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页
...the world's most energy friendly microcontrollers
2011-02-04 - d0002_Rev1.00
60
www.energymicro.com
3.5.2.4 Condition flags
If S is specified, these instructions:
update the N and Z flags according to the result
can update the C flag during the calculation of Operand2, see Section 3.3.3 (p. 38)
do not affect the V flag.
3.5.2.5 Examples
AND
R9, R2, #0xFF00
ORREQ
R2, R0, R5
ANDS
R9, R8, #0x19
EORS
R7, R11, #0x18181818
BIC
R0, R1, #0xab
ORN
R7, R11, R14, ROR #4
ORNS
R7, R11, R14, ASR #32
3.5.3 ASR, LSL, LSR, ROR, and RRX
Arithmetic Shift Right, Logical Shift Left, Logical Shift Right, Rotate Right, and Rotate Right with Extend.
3.5.3.1 Syntax
op{S}{cond} Rd, Rm, Rs
op{S}{cond} Rd, Rm, #n
RRX{S}{cond} Rd, Rm
where:
op
is one of:
ASR
Arithmetic Shift Right.
LSL
Logical Shift Left.
LSR
Logical Shift Right.
ROR
Rotate Right.
S
is an optional suffix. If S is specified, the condition code flags are updated on the result of the
operation, see Section 3.3.7 (p. 43) .
Rd
is the destination register.
Rm
is the register holding the value to be shifted.
Rs
is the register holding the shift length to apply to the value in Rm. Only the least significant byte is
used and can be in the range 0 to 255.
n
is the shift length. The range of shift length depends on the instruction:
ASR
shift length from 1 to 32
LSL
shift length from 0 to 31
LSR
shift length from 1 to 32
ROR
shift length from 1 to 31.
Note
MOV{S}{cond} Rd, Rm
is the preferred syntax for LSL{S}{cond} Rd, Rm, #0.
3.5.3.2 Operation
ASR
, LSL, LSR, and ROR move the bits in the register Rm to the left or right by the number of places
specified by constant n or register Rs.
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