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参数资料
| 型号： | EP1C6F144I8ES |
| 厂商： | Altera Corporation |
| 英文描述： | Cyclone FPGA Family Data Sheet |
| 中文描述： | 气旋的FPGA系列数据手册 |
| 文件页数： | 46/104页 |
| 文件大小： | 763K |
| 代理商： | EP1C6F144I8ES |
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2–40
Preliminary
Altera Corporation
January 2007
Cyclone Device Handbook, Volume 1
Figure 2–27. Cyclone IOE Structure
Note to
Figure 2–27
:
(1)
There are two paths available for combinatorial inputs to the logic array. Each path
contains a unique programmable delay chain.
The IOEs are located in I/O blocks around the periphery of the Cyclone
device. There are up to three IOEs per row I/O block and up to three IOEs
per column I/O block (column I/O blocks span two columns). The row
I/O blocks drive row, column, or direct link interconnects. The column
I/O blocks drive column interconnects.
Figure 2–28
shows how a row
I/O block connects to the logic array.
Figure 2–29
shows how a column
I/O block connects to the logic array.
Output Register
Output
Combinatorial
input
(1)
Input
OE Register
OE
Input Register
Logic Array
D
Q
D
Q
D
Q
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PDF描述 |
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