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参数资料
| 型号： | EP1C6T324I7ES |
| 厂商： | Altera Corporation |
| 英文描述： | Cyclone FPGA Family Data Sheet |
| 中文描述： | 气旋的FPGA系列数据手册 |
| 文件页数： | 84/104页 |
| 文件大小： | 763K |
| 代理商： | EP1C6T324I7ES |
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4–14
Preliminary
Altera Corporation
January 2007
Cyclone Device Handbook, Volume 1
Internal timing parameters are specified on a speed grade basis
independent of device density.
Tables 4–25
through
4–28
show the
internal timing microparameters for LEs, IOEs, TriMatrix memory
structures, DSP blocks, and MultiTrack interconnects.
Table 4–25. LE Internal Timing Microparameters
Symbol
-6
-7
-8
Unit
Min
Max
Min
Max
Min
Max
t
SU
29
33
37
ps
t
H
12
13
15
ps
t
CO
173
198
224
ps
t
LUT
454
522
590
ps
t
CLR
129
148
167
ps
t
PRE
129
148
167
ps
t
CLKHL
1,234
1,562
1,818
ps
Table 4–26. IOE Internal Timing Microparameters
Symbol
-6
-7
-8
Unit
Min
Max
Min
Max
Min
Max
t
SU
348
400
452
ps
t
H
0
0
0
ps
t
CO
511
587
664
ps
t
PIN2COMBOUT_R
1,130
1,299
1,469
ps
t
PIN2COMBOUT_C
1,135
1,305
1,475
ps
t
COMBIN2PIN_R
2,627
3,021
3,415
ps
t
COMBIN2PIN_C
2,615
3,007
3,399
ps
t
CLR
280
322
364
ps
t
PRE
280
322
364
ps
t
CLKHL
1,234
1,562
1,818
ps
相关PDF资料 |
PDF描述 |
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参数描述 |
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