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参数资料
型号： EP1S30F780C5N
厂商： Altera
文件页数： 302/864页
文件大小： 0K
描述： IC STRATIX FPGA 30K LE 780-FBGA
产品培训模块： Three Reasons to Use FPGA's in Industrial Designs
产品变化通告： Package Height Change 03/March/2008
标准包装： 18
系列： Stratix®
LAB/CLB数： 3247
逻辑元件/单元数： 32470
RAM 位总计： 3317184
输入/输出数： 597
电源电压： 1.425 V ~ 1.575 V
安装类型： 表面贴装
工作温度： 0°C ~ 85°C
封装/外壳： 780-BBGA
供应商设备封装： 780-FBGA（29x29）
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2–2
Altera Corporation
Stratix Device Handbook, Volume 2
July 2005
TriMatrix Memory
Table 2–1. Summary of TriMatrix Memory Features
Feature
M512 Block
M4K Block
M-RAM Block
Performance
319 MHz
290 MHz
287 MHz
Total RAM bits (including parity bits)
576
4,608
589,824
Configurations
512
× 1
256
× 2
128
× 4
64
× 8
64
× 9
32
× 16
32
× 18
4K
× 1
2K
× 2
1K
× 4
512
× 8
512
× 9
256
× 16
256
× 18
128
× 32
128
× 36
64K
× 8
64K
× 9
32K
× 16
32K
× 18
16K
× 32
16K
× 36
8K
× 64
8K
× 72
4K
× 128
4K
× 144
Parity bits
vv
v
Byte enable
vv
Single-port memory
vv
v
Simple dual-port memory
vv
v
True dual-port memory
vv
Embedded shift register
vv
ROM
vv
FIFO buffer
vv
v
Simple dual-port mixed width support
vv
v
True dual-port mixed width support
vv
Memory initialization file (.mif)
vv
Mixed-clock mode
vv
v
Power-up condition
Outputs cleared
Outputs unknown
Register clears
Input and output
registers (1)
Input and output
registers (2)
Output registers
Same-port read-during-write
New data available at
positive clock edge
New data available at
positive clock edge
New data available at
positive clock edge
Mixed-port read-during-write
Outputs set to
unknown or old data
Outputs set to
unknown or old data
Unknown output
Notes to Table 2–1:
(1)
The rden register on the M512 memory block does not have a clear port.
(2)
On the M4K block, asserting the clear port of the rden and byte enable registers drives the output of these registers
high.
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PDF描述
24AA02T-I/MS IC EEPROM 2KBIT 400KHZ 8MSOP
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ASM36DTBS CONN EDGECARD 72POS R/A .156 SLD
EP2SGX60CF780C3 IC STRATIX II GX 60K 780-FBGA
AGM36DTBS CONN EDGECARD 72POS R/A .156 SLD
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参数描述
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EP1S30F780C6N 功能描述:FPGA - 现场可编程门阵列 FPGA - Stratix I 3247 LABs 597 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256
EP1S30F780C7 功能描述:FPGA - 现场可编程门阵列 FPGA - Stratix I 3247 LABs 597 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256
EP1S30F780C7N 功能描述:FPGA - 现场可编程门阵列 FPGA - Stratix I 3247 LABs 597 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256
EP1S30F780C8 功能描述:FPGA - 现场可编程门阵列 FPGA - Stratix I 3247 LABs 597 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256
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