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参数资料
型号： EP1SGX10CF672C6N
厂商： Altera
文件页数： 1128/1456页
文件大小： 0K
描述： IC STRATIX GX FPGA 10KLE 672FBGA
产品培训模块： Three Reasons to Use FPGA's in Industrial Designs
标准包装： 20
系列： Stratix® GX
LAB/CLB数： 1057
逻辑元件/单元数： 10570
RAM 位总计： 920448
输入/输出数： 362
电源电压： 1.425 V ~ 1.575 V
安装类型： 表面贴装
工作温度： 0°C ~ 85°C
封装/外壳： 672-BBGA
供应商设备封装： 672-BGA（27x27）
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4–32
Altera Corporation
Stratix GX Device Handbook, Volume 2
June 2006
SONET Mode MegaWizard Plug-In Manager
rx_locktodata
(control signal
for Receiver PLL to lock to the
received data)
Refer to the Ports & Parameters chapter in volume 2 of the Stratix GX
Device Handbook.
rx_clkout
(receiver input clock)
The rx_clkout signal is a recovered clock output from individual
receiver channels. One rx_clkout signal is available per channel.
rx_locked
(indicates that the
Receiver PLL is locked to the
reference clock (active low))
Transmitter PLL and receiver PLL lock indicator.
For pll_locked, High = transmitter PLL is locked to the reference
clock.
For rx_locked, Low = receiver PLL is locked to the reference clock.
rx_freqlocked
(indicates that
the Receiver PLL is locked to the
input data)
Refer to the Ports & Parameters chapter in volume 2 of the Stratix GX
Device Handbook.
rx_signaldetect
(indicates
receiver signal is detected with data)
Refer to the Ports & Parameters chapter in volume 2 of the Stratix GX
Device Handbook.
rx_syncstatus
(output signal
from pattern detector and word
aligner)
Indicates when the word aligner has aligned to the byte boundary. The
rx_syncstatus
signal goes high for one rx_clkout period when the
word aligner aligns to the new byte boundary. In 16-bit mode, each high
and low byte has a separate rx_syncstatus signal.
rx_patterndetect
(indicates
pattern has been detected)
Similar to rx_syncstatus, except that rx_patterndetect asserts
only when the word alignment pattern appears in the data stream within
the synchronized byte boundary.
rx_ctrldetect
(indicates
8B/10B decoder detected a control
code)
Refer to the Ports & Parameters chapter in volume 2 of the Stratix GX
Device Handbook.
rx_errdetect
(indicates 8B/10B
decoder detected an error code
Refer to the Ports & Parameters chapter in volume 2 of the Stratix GX
Device Handbook.
rx_disperr
(indicates 8B/10B
decoder detected disparity error)
Refer to the Ports & Parameters chapter in volume 2 of the Stratix GX
Device Handbook.
rx_a1a2sizeout
(a1a2size
signal synchronized to the clock of
the word aligner)
A loopback of the rx_a1a2size signal that is synchronized with the
current byte from the word aligner.
rx_fifoalmostempty
(high
when rate matching FIFO is in
almost empty condition)
If Generic FIFO is enabled to perform rate matching between the
recovered clock and local receiver clock, this signal indicates an almost
empty condition when driven HIGH.
rx_fifoalmostfull
(high when
rate matching FIFO is in almost full
condition)
If Generic FIFO is enabled to perform rate matching between the
recovered clock and local receiver clock, this signal indicates an almost
full condition when driven HIGH.
rx_bisterr
(error status for
built-in self-test)
Refer to the Ports & Parameters chapter in volume 2 of the Stratix GX
Device Handbook.
rx_bistdone
(self-test complete
signal)
Refer to the Ports & Parameters chapter in volume 2 of the Stratix GX
Device Handbook.
Table 4–8. MegaWizard Plug-In Manager Options (Page 7 for SONET Mode) (Part 2 of 2)
altgxb Setting
Description
相关PDF资料
PDF描述
A42MX36-2PQ240 IC FPGA MX SGL CHIP 54K 240-PQFP
ACC43DRAH CONN EDGECARD 86POS .100 R/A DIP
ACM44DSAN CONN EDGECARD 88POS R/A .156 SLD
ACM44DSAH CONN EDGECARD 88POS R/A .156 SLD
ASM28DRMD CONN EDGECARD 56POS .156 WW
相关代理商/技术参数
参数描述
EP1SGX10CF672C6NGA 制造商:Altera 功能描述:EP1SGX10CF672C6NGA
EP1SGX10CF672C7 功能描述:FPGA - 现场可编程门阵列 FPGA - Stratix I GX 1057 LABs 362 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256
EP1SGX10CF672C7N 功能描述:FPGA - 现场可编程门阵列 FPGA - Stratix I GX 1057 LABs 362 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256
EP1SGX10D 制造商:ALTERA 制造商全称:Altera Corporation 功能描述:StratixGX FPGA Family
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