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参数资料
| 型号： | EP1SGX25FF1020C7ES |
| 厂商： | ALTERA CORP |
| 元件分类： | FPGA |
| 英文描述： | FPGA, PBGA1020 |
| 封装： | 33 X 33 MM, 1 MM PITCH, FBGA-1020 |
| 文件页数： | 62/279页 |
| 文件大小： | 3671K |
| 代理商： | EP1SGX25FF1020C7ES |
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4–88
Altera Corporation
Stratix GX Device Handbook, Volume 1
February 2005
PLLs & Clock Networks
pair of output pins (four pins total) has dedicated
VCC and GND pins to
reduce the output clock’s overall jitter by providing improved isolation
from switching I/O pins.
For PLLs 5 and 6, each pin of a single-ended output pair can either be in
phase or 180° out of phase. The clock output pin pairs support the same
I/O standards as standard output pins (in the top and bottom banks) as
well as LVDS, LVPECL, 3.3-V PCML, HyperTransport technology,
differential HSTL, and differential SSTL. Table 4–19 shows which I/O
standards the enhanced PLL clock pins support. When in single-ended or
differential mode, the two outputs operate off the same power supply.
Both outputs use the same standards in single-ended mode to maintain
performance. You can also use the external clock output pins as user
output pins if external enhanced PLL clocking is not needed.
Table 4–19. I/O Standards Supported for Enhanced PLL Pins (Part 1 of 2)
I/O Standard
Input
Output
INCLK
FBIN
PLLENABLE
EXTCLK
LVTTL
vvvv
LVCMOS
vvvv
2.5 V
vv
v
1.8 V
vv
v
1.5 V
vv
v
3.3-V PCI
vv
v
3.3-V PCI-X
vv
v
LVPECL
vv
v
3.3-V PCML
vv
v
LVDS
vv
v
HyperTransport technology
vv
v
Differential HSTL
vv
Differential SSTL
v
3.3-V GTL
vv
v
3.3-V GTL+
vv
v
1.5-V HSTL class I
vv
v
1.5-V HSTL class II
vv
v
SSTL-18 class I
vv
v
SSTL-18 class II
vv
v
SSTL-2 class I
vv
v
SSTL-2 class II
vv
v
相关PDF资料 |
PDF描述 |
|---|---|
| EP1SGX25FF1020I5ES | FPGA, PBGA1020 |
| EP1SGX25FF1020I5N | FPGA, PBGA1020 |
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| EP1SGX25FF1020I7ES | FPGA, PBGA1020 |
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相关代理商/技术参数 |
参数描述 |
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| EP1SGX25FF1020I6N | 功能描述:FPGA - 现场可编程门阵列 FPGA - Stratix I GX 2566 LABs 607 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
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