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参数资料
| 型号： | EP20K200RI240-3 |
| 英文描述： | Field Programmable Gate Array (FPGA) |
| 中文描述： | 现场可编程门阵列（FPGA） |
| 文件页数： | 113/114页 |
| 文件大小： | 1623K |
| 代理商： | EP20K200RI240-3 |
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98
Altera Corporation
APEX 20K Programmable Logic Device Family Data Sheet
ESB Timing Microparameters, fMAX Routing Delays, Minimum Pulse
Width Timing Parameters, External Timing Parameters, and External
Bidirectional Timing Parameters for EP20K300E APEX 20KE devices.
Table 82. EP20K200E External Bidirectional Timing Parameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tINSUBIDIR
2.81
3.19
3.54
ns
tINHBIDIR
0.00
ns
tOUTCOBIDIR
2.00
5.12
2.00
5.62
2.00
6.11
ns
tXZBIDIR
7.51
8.32
8.67
ns
tZXBIDIR
7.51
8.32
8.67
ns
tINSUBIDIRPLL
3.30
3.64
-
ns
tINHBIDIRPLL
0.00
-
ns
tOUTCOBIDIRPLL
0.50
3.01
0.50
3.36
-
ns
tXZBIDIRPLL
5.40
6.05
-
ns
tZXBIDIRPLL
5.40
6.05
-
ns
Table 83. EP20K300E fMAX LE Timing Microparameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tSU
0.22
0.23
ns
tH
0.22
0.23
ns
tCO
0.24
0.29
0.32
ns
tLUT
0.67
0.83
1.01
ns
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PDF描述 |
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