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参数资料
| 型号： | EP20K600CB652I8ES |
| 元件分类： | CPU监测 |
| 英文描述： | RTC Module With CPU Supervisor |
| 中文描述： | 时钟模块CPU监控 |
| 文件页数： | 101/114页 |
| 文件大小： | 1623K |
| 代理商： | EP20K600CB652I8ES |
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Altera Corporation
87
APEX 20K Programmable Logic Device Family Data Sheet
Table 56. EP20K30E Minimum Pulse Width Timing Parameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tCH
0.55
0.78
1.15
ns
tCL
0.55
0.78
1.15
ns
tCLRP
0.22
0.31
0.46
ns
tPREP
0.22
0.31
0.46
ns
tESBCH
0.55
0.78
1.15
ns
tESBCL
0.55
0.78
1.15
ns
tESBWP
1.43
2.01
2.97
ns
tESBRP
1.15
1.62
2.39
ns
Table 57. EP20K30E External Timing Parameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tINSU
2.02
2.13
2.24
ns
tINH
0.00
ns
tOUTCO
2.00
4.88
2.00
5.36
2.00
5.88
ns
tINSUPLL
2.11
2.23
-
ns
tINHPLL
0.00
-
ns
tOUTCOPLL
0.50
2.60
0.50
2.88
-
ns
Table 58. EP20K30E External Bidirectional Timing Parameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tINSUBIDIR
1.85
1.77
1.54
ns
tINHBIDIR
0.00
ns
tOUTCOBIDIR
2.00
4.88
2.00
5.36
2.00
5.88
ns
tXZBIDIR
7.48
8.46
9.83
ns
tZXBIDIR
7.48
8.46
9.83
ns
tINSUBIDIRPLL
4.12
4.24
-
ns
tINHBIDIRPLL
0.00
-
ns
tOUTCOBIDIRPLL
0.50
2.60
0.50
2.88
-
ns
tXZBIDIRPLL
5.21
5.99
-
ns
tZXBIDIRPLL
5.21
5.99
-
ns
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PDF描述 |
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参数描述 |
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| EP20K600CB672C8 | 功能描述:FPGA - 现场可编程门阵列 CPLD - APEX 20K 2432 Macros 508 IO RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| EP20K600CF1020I7ES | 制造商:未知厂家 制造商全称:未知厂家 功能描述:ASIC |
| EP20K600CF1020I8ES | 制造商:未知厂家 制造商全称:未知厂家 功能描述:ASIC |
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