参数资料
| 型号： | EP4SGX110DF29C2XN |
| 厂商： | Altera |
| 文件页数： | 70/82页 |
| 文件大小： | 0K |
| 描述： | IC STRATIX IV FPGA 110K 780FBGA |
| 产品培训模块： | Three Reasons to Use FPGA's in Industrial Designs |
| 标准包装： | 3 |
| 系列： | Stratix® IV GX |
| LAB/CLB数： | 4224 |
| 逻辑元件/单元数： | 105600 |
| RAM 位总计： | 9793536 |
| 输入/输出数： | 372 |
| 电源电压： | 0.87 V ~ 0.93 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 780-BBGA |
| 供应商设备封装： | 780-FBGA（29x29） |
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1–64
Chapter 1: DC and Switching Characteristics for Stratix IV Devices
Glossary
Stratix IV Device Handbook
March 2014
Altera Corporation
Volume 4: Device Datasheet and Addendum
Glossary
Table 1–54 lists the glossary for this chapter.
Table 1–54. Glossary Table (Part 1 of 4)
Letter
Subject
Definitions
A, B, C
——
D
Differential I/O
Standards
Receiver Input Waveforms
Transmitter Output Waveforms
E
——
F
fHSCLK
Left/right PLL input clock frequency.
fHSDR
High-speed I/O block: Maximum/minimum LVDS data transfer rate
(fHSDR = 1/TUI), non-DPA.
fHSDRDPA
High-speed I/O block: Maximum/minimum LVDS data transfer rate
(fHSDRDPA = 1/TUI), DPA.
G, H, I
——
Single-Ended Waveform
Differential Waveform
Positive Channel (p) = VIH
Negative Channel (n) = VIL
Ground
VID
p
n = 0 V
VCM
Single-Ended Waveform
Differential Waveform
Positive Channel (p) = VOH
Negative Channel (n) = VOL
Ground
VOD
p
n = 0 V
VCM
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PDF描述 |
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| EP4SGX110DF29C4N | 功能描述:FPGA - 现场可编程门阵列 FPGA - Stratix IV GX 4224 LABs 372 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
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