参数资料
| 型号： | EP7312-CR |
| 厂商： | Cirrus Logic Inc |
| 文件页数： | 10/54页 |
| 文件大小： | 0K |
| 描述： | IC ARM720T MCU 74MHZ 204-TFBGA |
| 标准包装： | 119 |
| 系列： | EP7 |
| 核心处理器： | ARM7 |
| 芯体尺寸： | 32-位 |
| 速度： | 74MHz |
| 连通性： | 编解码器，DAI，EBI/EMI，IrDA，键盘，SPI/Microwire1，UART/USART |
| 外围设备： | LCD，LED，MaverickKey，PWM |
| 输入/输出数： | 27 |
| 程序存储器类型： | ROMless |
| RAM 容量： | 56K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.3 V ~ 2.7 V |
| 振荡器型： | 外部 |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 204-TFBGA |
| 包装： | 托盘 |
| 配用： | 598-1209-ND - KIT DEVELOPMENT EP73XX ARM7 |
| 其它名称： | 598-1235 |
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18
Copyright Cirrus Logic, Inc. 2011
(All Rights Reserved)
DS508F2
EP7312
High-Performance, Low-Power System on Chip
SDRAM Burst Read Cycle
Note:
1. Timings are shown with CAS latency = 2
2. The SDCLK signal may be phase shifted relative to the rest of the SDRAM control and data signals due to uneven loading.
Designers should take care to ensure that delays between SDRAM control and data signals are approximately equal.
ADRAS
ADCAS
SDCLK
SDCS
SDRAS
SDCAS
SDQM
[0:3]
ADDR
DATA
SDMWE
D1
D4
D3
D2
t
ADv
t
ADv
t
CSd
t
CSa
t
CSa
t
CAa
t
RAd
t
CSd
t
CAd
t
RAa
t
DAh
t
DAs
t
DAh
t
DAs
t
DAh
t
DAs
t
DAh
t
DAs
t
RAnv
Figure 4. SDRAM Burst Read Cycle Timing Measurement
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参数描述 |
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