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参数资料
| 型号： | EP9301-IQ |
| 厂商： | Cirrus Logic, Inc. |
| 英文描述： | Entry-level ARM9 System-on-chip Processor |
| 中文描述： | 入门级ARM9的系统芯片处理器 |
| 文件页数： | 14/41页 |
| 文件大小： | 297K |
| 代理商： | EP9301-IQ |
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14
Copyright 2005 Cirrus Logic (All Rights Reserved)
DS636PP5
EP9301
Entry Level ARM9 System-on-Chip Processor
Memory Interface
SDRAM Load Mode Register Cycle
Figure 2
through
Figure 5
define the timings associated with all phases of the SDRAM. The following table contains the
values for the timings of each of the SDRAM modes.
Parameter
Symbol
Min
Typ
Max
Unit
SDCLK high time
t
clk_high
-
(t
HCLK
) / 2
-
ns
SDCLK low time
t
clk_low
-
(t
HCLK
) / 2
-
ns
SDCLK rise/fall time
t
clkrf
-
2
4
ns
Signal delay from SDCLK rising edge time
t
d
-
-
8
ns
Signal hold from SDCLK rising edge time
t
h
1
-
-
ns
DQMn delay from SDCLK rising edge time
t
DQd
-
-
8
ns
DQMn hold from SDCLK rising edge time
t
DQh
1
-
-
ns
DA valid setup to SDCLK rising edge time
t
DAs
2
-
-
ns
DA valid hold from SDCLK rising edge time
t
DAh
3
-
-
ns
Figure 2. SDRAM Load Mode Register Cycle Timing Measurement
SDCLK
SDCSn
RASn
CASn
SDWEn
DQMn
AD
DA
OP-Code
t
clk_high
t
clk_low
t
clkrf
t
d
t
h
相关PDF资料 |
PDF描述 |
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参数描述 |
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