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参数资料
| 型号： | EP9315-EBZ |
| 厂商： | Cirrus Logic, Inc. |
| 英文描述： | Enhanced Universal Platform System-on-Chip Processor |
| 中文描述： | 增强型通用平台上系统芯片处理器 |
| 文件页数： | 14/64页 |
| 文件大小： | 1031K |
| 代理商： | EP9315-EBZ |
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Copyright 2005 Cirrus Logic (All Rights Reserved)
DS638PP4
EP9315
Enhanced Universal Platform SOC Processor
Timings
Timing Diagram Conventions
This data sheet contains one or more timing diagrams. The following key explains the components used in these
diagrams. Any variations are clearly labelled when they occur. Therefore, no additional meaning should be attached
unless specifically stated.
Figure 1. Timing Diagram Drawing Key
Timing Conditions
Unless specified otherwise, the following conditions are true for all timing measurements.
T
A
= 0 to 70° C
CVDD = VDD_PLL = 1.8V
RVDD = 3.3 V
All grounds = 0 V
Logic 0 = 0 V, Logic 1 = 3.3 V
Output loading = 50 pF
Timing reference levels = 1.5 V
The Processor Bus Clock (HCLK) is programmable and is set by the user. The frequency is typically between
33 MHz and 100 MHz (92 MHz for industrial conditions).
Clock
High to Low
High/Low to High
Bus Change
Bus Valid
Undefined/Invalid
Valid Bus to Tristate
Bus/Signal Omission
相关PDF资料 |
PDF描述 |
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| EP9315-IBZ | Enhanced Universal Platform System-on-Chip Processor |
| EP9315 | Enhanced Universal Platform System-on-Chip Processor |
| EP9315-CB | Enhanced Universal Platform System-on-Chip Processor |
| EP9315-CBZ | Enhanced Universal Platform System-on-Chip Processor |
相关代理商/技术参数 |
参数描述 |
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