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参数资料
| 型号： | EPF10K30E |
| 厂商： | Altera Corporation |
| 英文描述： | Embedded Programmable Logic Family(FLEX10KE嵌入式可编程逻辑系列) |
| 中文描述： | 嵌入式可编程逻辑系列（FLEX10KE嵌入式可编程逻辑系列） |
| 文件页数： | 13/121页 |
| 文件大小： | 2001K |
| 代理商： | EPF10K30E |
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Altera Corporation
13
Preliminary Information
FLEX 10KE Embedded Programmable Logic Family Data Sheet
The FLEX 10KE EAB can be used in a single-port mode, which is useful
for backward-compatibility with FLEX 10K designs (see
Figure 4
).
Figure 4. FLEX 10KE Device in Single-Port RAM Mode
Note:
(1)
EPF10K30E, EPF10K50E, and EPF10K50S devices have 88 EAB local interconnect channels; EPF10K100E,
EPF10K100B, EPF10K130E, EPF10K200E, and EPF10K200S devices have 104 EAB local interconnect channels.
EABs can be used to implement synchronous RAM, which is easier to use
than asynchronous RAM. A circuit using asynchronous RAM must
generate the RAM write enable signal, while ensuring that its data and
address signals meet setup and hold time specifications relative to the
write enable signal. In contrast, the EAB’s synchronous RAM generates its
own write enable signal and is self-timed with respect to the input or write
clock. A circuit using the EAB’s self-timed RAM must only meet the setup
and hold time specifications of the global clock.
Column Interconnect
EAB Local
Interconnect
(1)
Dedicated Inputs
& Global Signals
D
Q
D
Q
RAM/ROM
256
×
16
×
8
1,512
×
4
2,048
×
2
Data In
Address
Write Enable
Data Out
4, 8, 16, 32
4, 8, 16, 32
D
Q
D
Q
4
8, 4, 2, 1
8, 9, 10, 11
Row Interconnect
Dedicated
Clocks
2
4, 8
Chip-Wide
Reset
相关PDF资料 |
PDF描述 |
|---|---|
| EPF10K50S | Embedded Programmable Logic Family(FLEX10KE嵌入式可编程逻辑系列) |
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相关代理商/技术参数 |
参数描述 |
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