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参数资料
| 型号： | EPF6024AQC240-1 |
| 厂商： | ALTERA CORP |
| 元件分类： | PLD |
| 英文描述： | LOADABLE PLD, PQFP240 |
| 封装： | PLASTIC, QFP-240 |
| 文件页数： | 22/57页 |
| 文件大小： | 508K |
| 代理商： | EPF6024AQC240-1 |
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Altera Corporation
29
FLEX 6000 Programmable Logic Device Family Data Sheet
The instruction register length for FLEX 6000 devices is three bits. Table 9
shows the boundary-scan register length for FLEX 6000 devices.
FLEX 6000 devices include a weak pull-up on JTAG pins.
f
Devices) for more information.
Figure 16 shows the timing requirements for the JTAG signals.
Figure 16. JTAG Waveforms
Table 10 shows the JTAG timing parameters and values for FLEX 6000
devices.
Table 9. FLEX 6000 Device Boundary-Scan Register Length
Device
Boundary-Scan Register Length
EPF6010A
522
EPF6016
621
EPF6016A
522
EPF6024A
666
TDO
TCK
tJPZX
t
JPCO
tJPH
t JPXZ
tJCP
tJPSU
t JCL
tJCH
TDI
TMS
Signal
to Be
Captured
Signal
to Be
Driven
t
JSZX
tJSSU
tJSH
t
JSCO
tJSXZ
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PDF描述 |
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参数描述 |
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