- 您现在的位置：买卖IC网 > PDF目录97930 > EPM3064ATC44-7 Electrically-Erasable Complex PLD PDF资料下载
参数资料
| 型号： | EPM3064ATC44-7 |
| 英文描述： | Electrically-Erasable Complex PLD |
| 中文描述： | 电可擦除复杂可编程逻辑器件 |
| 文件页数： | 1/53页 |
| 文件大小： | 839K |
| 代理商： | EPM3064ATC44-7 |
当前第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页
Altera Corporation
1
MAX 3000A
Programmable Logic
Device Family
September 2000, ver. 1.1
Data Sheet
A-DS-M3000A-01.1
Features...
s
High-performance, low-cost CMOS EEPROM-based programmable
logic devices (PLDs) built on a Multiple Array MatriX (MAX)
architecture (see Table 1)
s
3.3-V in-system programmability (ISP) through the built-in
IEEE Std. 1149.1 Joint Test Action Group (JTAG) interface with
advanced pin-locking capability
s
Built-in boundary-scan test (BST) circuitry compliant with
IEEE Std. 1149.1-1990
s
Enhanced ISP features:
–
Enhanced ISP algorithm for faster programming
–
ISP_Done bit to ensure complete programming
–
Pull-up resistor on I/O pins during in-system programming
s
High-density PLDs ranging from 600 to 5,000 usable gates
s
4.5-ns pin-to-pin logic delays with counter frequencies of up to
227.3 MHz
s
MultiVoltTM I/O interface enabling the device core to run at 3.3 V,
while I/O pins are compatible with 5.0-V, 3.3-V, and 2.5-V logic
levels
s
Pin counts ranging from 44 to 208 in a variety of thin quad flat pack
(TQFP), plastic quad flat pack (PQFP), and plastic J-lead chip carrier
(PLCC) packages
s
Hot-socketing support
s
Programmable interconnect array (PIA) continuous routing structure
for fast, predictable performance
s
PCI compatible
s
Bus-friendly architecture including programmable slew-rate control
s
Open-drain output option
Table 1. MAX 3000A Device Features
Feature
EPM3032A
EPM3064A
EPM3128A
EPM3256A
Usable gates
600
1,250
2,500
5,000
Macrocells
32
64
128
256
Logic array blocks
2
4
8
16
Maximum user I/O
pins
34
66
96
158
tPD (ns)
4.5
5.0
5.5
tSU (ns)
2.9
2.8
3.3
3.9
tCO1 (ns)
3.0
3.1
3.4
3.5
fCNT (MHz)
227.3
222.2
192.3
172.4
相关PDF资料 |
PDF描述 |
|---|---|
| EPM3128ATC100-10 | |
| EPM3128ATC100-5 | Electrically-Erasable Complex PLD |
| EPM3128ATC100-7 | |
| EPM3128ATC144-10 | |
| EPM3128ATC144-5 | Electrically-Erasable Complex PLD |
相关代理商/技术参数 |
参数描述 |
|---|---|
| EPM3064ATC44-7N | 功能描述:CPLD - 复杂可编程逻辑器件 CPLD - MAX 3000A 64 Macro 34 IOs RoHS:否 制造商:Lattice 系列: 存储类型:EEPROM 大电池数量:128 最大工作频率:333 MHz 延迟时间:2.7 ns 可编程输入/输出端数量:64 工作电源电压:3.3 V 最大工作温度:+ 90 C 最小工作温度:0 C 封装 / 箱体:TQFP-100 |
| EPM3064ATI10010 | 制造商:Altera Corporation 功能描述: |
| EPM3064ATI100-10 | 功能描述:CPLD - 复杂可编程逻辑器件 CPLD - MAX 3000A 64 Macro 66 IOs RoHS:否 制造商:Lattice 系列: 存储类型:EEPROM 大电池数量:128 最大工作频率:333 MHz 延迟时间:2.7 ns 可编程输入/输出端数量:64 工作电源电压:3.3 V 最大工作温度:+ 90 C 最小工作温度:0 C 封装 / 箱体:TQFP-100 |
| EPM3064ATI100-10N | 功能描述:CPLD - 复杂可编程逻辑器件 CPLD - MAX 3000A 64 Macro 66 IOs RoHS:否 制造商:Lattice 系列: 存储类型:EEPROM 大电池数量:128 最大工作频率:333 MHz 延迟时间:2.7 ns 可编程输入/输出端数量:64 工作电源电压:3.3 V 最大工作温度:+ 90 C 最小工作温度:0 C 封装 / 箱体:TQFP-100 |
| EPM3064ATI44-10 | 功能描述:CPLD - 复杂可编程逻辑器件 CPLD - MAX 3000A 64 Macro 34 IOs RoHS:否 制造商:Lattice 系列: 存储类型:EEPROM 大电池数量:128 最大工作频率:333 MHz 延迟时间:2.7 ns 可编程输入/输出端数量:64 工作电源电压:3.3 V 最大工作温度:+ 90 C 最小工作温度:0 C 封装 / 箱体:TQFP-100 |
发布紧急采购，3分钟左右您将得到回复。