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参数资料
| 型号： | EPM3256AFC256-7 |
| 厂商： | Altera |
| 文件页数： | 24/46页 |
| 文件大小： | 0K |
| 描述： | IC MAX 3000A CPLD 256 256-FBGA |
| 标准包装： | 90 |
| 系列： | MAX® 3000A |
| 可编程类型： | 系统内可编程 |
| 最大延迟时间 tpd(1)： | 7.5ns |
| 电压电源 - 内部： | 3 V ~ 3.6 V |
| 逻辑元件/逻辑块数目： | 16 |
| 宏单元数： | 256 |
| 门数： | 5000 |
| 输入/输出数： | 161 |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 256-BGA |
| 供应商设备封装： | 256-FBGA（17x17） |
| 包装： | 托盘 |
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30
Altera Corporation
MAX 3000A Programmable Logic Device Family Data Sheet
tPIA
PIA delay
0.9
1.5
2.1
ns
tLPA
Low–power adder
2.5
4.0
5.0
ns
Table 18. EPM3064A External Timing Parameters
Symbol
Parameter
Conditions
Speed Grade
Unit
–4
–7
–10
Min
Max
Min
Max
Min
Max
tPD1
Input to non–registered
output
C1 = 35 pF (2)
4.5
7.5
10.0
ns
tPD2
I/O input to non–registered
output
C1 = 35 pF (2)
4.5
7.5
10.0
ns
tSU
Global clock setup time
2.8
4.7
6.2
ns
tH
Global clock hold time
0.0
ns
tCO1
Global clock to output delay C1 = 35 pF
1.0
3.1
1.0
5.1
1.0
7.0
ns
tCH
Global clock high time
2.0
3.0
4.0
ns
tCL
Global clock low time
2.0
3.0
4.0
ns
tASU
Array clock setup time
1.6
2.6
3.6
ns
tAH
Array clock hold time
0.3
0.4
0.6
ns
tACO1
Array clock to output delay
C1 = 35 pF (2)
1.04.3
1.07.2
1.09.6
ns
tACH
Array clock high time
2.0
3.0
4.0
ns
tACL
Array clock low time
2.0
3.0
4.0
ns
tCPPW
Minimum pulse width for
clear and preset
2.0
3.0
4.0
ns
tCNT
Minimum global clock
period
4.5
7.4
10.0
ns
fCNT
Maximum internal global
clock frequency
222.2
135.1
100.0
MHz
tACNT
Minimum array clock period (2)
4.5
7.4
10.0
ns
fACNT
Maximum internal array
clock frequency
222.2
135.1
100.0
MHz
Table 17. EPM3032A Internal Timing Parameters (Part 2 of 2)
Note (1)
Symbol
Parameter
Conditions
Speed Grade
Unit
–4
–7
–10
Min
Max
Min
Max
Min
Max
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PDF描述 |
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