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参数资料
| 型号： | EPM7128AFC100-10 |
| 文件页数： | 21/60页 |
| 文件大小： | 1030K |
| 代理商： | EPM7128AFC100-10 |
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Altera Corporation
MAX 7000A Programmable Logic Device Data Sheet
Figure 11. MAX 7000A Timing Model
The timing characteristics of any signal path can be derived from the
timing model and parameters of a particular device. External timing
parameters, which represent pin-to-pin timing delays, can be calculated
as the sum of internal parameters. Figure 12 shows the timing relationship
between internal and external delay parameters.
information.
Logic Array
Delay
t LAD
Output
Delay
t OD3
t OD2
t OD1
t XZ
Z
t X1
t ZX2
t ZX3
Input
Delay
t IN
Register
Delay
t SU
t H
t PRE
t CLR
t RD
t COMB
t FSU
t FH
PIA
Delay
t PIA
Shared
Expander Delay
t SEXP
Register
Control Delay
t LAC
t IC
t EN
I/O
Delay
t IO
Global Control
Delay
t GLOB
Internal Output
Enable Delay
t IOE
Parallel
Expander Delay
t PEXP
Fast
Input Delay
t FIN
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PDF描述 |
|---|---|
| EPM7128ALC84-10 | |
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| EPM7128ALC84-7 | |
| EPM7128ATC100-10 | |
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参数描述 |
|---|---|
| EPM7128AFC100-6 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
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