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参数资料
| 型号： | EVAL-AD5272SDZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 13/28页 |
| 文件大小： | 0K |
| 描述： | BOARD EVAL FOR AD5272 |
| 标准包装： | 1 |
| 主要目的： | 数字电位器 |
| 嵌入式： | 否 |
| 已用 IC / 零件： | AD5272 |
| 主要属性： | 1 通道，1024 位置 |
| 次要属性： | 2.7 ~ 5.5 V，5 ppm/°C，I²C |
| 已供物品： | 电路板，CD，器件，稳压器 |
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AD5272/AD5274
Data Sheet
Rev. D | Page 20 of 28
READ OPERATION
When reading data back from the AD5272/AD5274, the user
must first issue a readback command to the device, this begins
with a start command followed by an address byte (R/W = 0),
after which the AD5272/AD5274 acknowledges that it is
prepared to receive data by pulling SDA low.
Two bytes of data are then written to the AD5272/AD5274, the
most significant byte followed by the least significant byte; both
of these data bytes are acknowledged by the AD5272/AD5274.
A stop condition follows. These bytes contain the read instruc-
tion, which enables readback of the RDAC register, 50-TP
memory, or the control register. The user can then read back
the data beginning with a start command followed by an
address byte (R/W = 1), after which the device acknowledges
that it is prepared to transmit data by pulling SDA low. Two
bytes of data are then read from the device, as shown in Figure 45.
A stop condition follows. If the master does not acknowledge
the first byte, the second byte is not transmitted by the
AD5272/AD5274.
0
19
1
99
9
1
0
1
A1
A0
R/W
0
C3
C2
C1
C0
D9
D8
D7
D6
D5
D4
D3
D2
D1
D0
0
19
1
99
9
1
0
1
A1
A0
R/W
0
X
D9
D8
D7
D6
D5
D4
D3
D2
D1
D0
ACK. BY
AD5272/AD5274
ACK. BY
AD5272/AD5274
ACK. BY
AD5272/AD5274
ACK. BY
AD5272/AD5274
ACK. BY
MASTER
NO ACK. BY
MASTER
08
07
6-
0
07
SCL
SDA
SCL (CONTINUED)
SDA (CONTINUED)
SCL (CONTINUED)
SDA (CONTINUED)
START BY
MASTER
SCL
SDA
START BY
MASTER
STOP BY
MASTER
STOP BY
MASTER
FRAME 1
SERIAL BUS ADDRESS BYTE
FRAME 1
SERIAL BUS ADDRESS BYTE
FRAME 2
MOST SIGNIFICANT DATA BYTE
FRAME 2
MOST SIGNIFICANT DATA BYTE
FRAME 3
LEAST SIGNIFICANT DATA BYTE
FRAME 3
LEAST SIGNIFICANT DATA BYTE
Figure 45. Read Command
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PDF描述 |
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参数描述 |
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