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参数资料
| 型号： | HFA3783 |
| 厂商： | HARRIS SEMICONDUCTOR |
| 元件分类： | 衰减器 |
| 英文描述： | 288 MACROCELL 3.3 VOLT ISP CPLD |
| 中文描述： | 70 MHz - 600 MHz RF/MICROWAVE I/Q MODEM |
| 文件页数： | 12/34页 |
| 文件大小： | 608K |
| 代理商： | HFA3783 |
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12
DC Offset Calibration Counter
BIT
DESCRIPTION
C(0-6)
Least Significant bit C(0) to Most significant bit C(6) of the offset calibration counter/divider. The calibration clock frequency and
calibration time is defined by the Reference signal frequency divided down by this counter as follows:
C(11)
Set output bias level for AC coupling applications and TX/RX switching improvement in performance.
CAL TIME = 22
-----------------------------------
DAT/CLK
HOLD
CLK WIDTH
HIGH
CLK WIDTH
LOW
CLK/LE
SET UP
LE
LSB
BIT 1
BIT 2
CLK
DATA
LE
FIGURE 1. PLL SYNTHESIZER SERIAL INTERFACE TIMING DIAGRAM
MSB
BIT 20
P. WIDTH
DAT/CLK
SET UP
HFA3783
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