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参数资料
| 型号： | HI1171JCB |
| 厂商： | Intersil |
| 文件页数： | 4/7页 |
| 文件大小： | 0K |
| 描述： | IC DAC 8BIT 40MSPS HS 24-SOIC |
| 标准包装： | 300 |
| 设置时间： | 10ns |
| 位数： | 8 |
| 数据接口： | 并联 |
| 转换器数目： | 1 |
| 电压电源： | 模拟和数字 |
| 功率耗散（最大）： | 80mW |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-SOIC（0.209"，5.30mm 宽） |
| 供应商设备封装： | 24-SOIC W |
| 包装： | 管件 |
| 输出数目和类型： | 2 电流，单极 |
| 采样率（每秒）： | 40M |
4
Propagation Delay Time, tPD
See Figure 9
-
10
-
ns
Settling Time, tSET (to
1/
2 LSB)
See Figure 1
-
10
15
ns
CLK Pulse Width, tPW1, tPW2
See Figure 1
12.5
-
ns
POWER SUPPLY CHARACTERISITICS
IAVDD
14.3MHz, at Color Bar Data Input
-
10.9
11.5
mA
IDVDD
14.3MHz, at Color Bar Data Input
-
4.2
4.8
mA
Power Dissipation
200
load at 2VP-P Output
-
80
mW
NOTES:
2. Excludes error due to external reference drift.
3. Parameter guaranteed by design or characterization and not production tested.
4. Electrical specifications guaranteed only under the stated operating conditions.
Electrical Specifications
AVDD = +4.75V to +5.25V, DVDD = +4.75 to +5.25V, VREF = +2.0V, fS = 40MHz,
CLK Pulse Width = 12.5ns, TA = 25
oC (Note 4) (Continued)
PARAMETER
TEST CONDITIONS
MIN
TYP
MAX
UNITS
Timing Diagram
FIGURE 1.
CLK
DATA
D/AOUT
100%
50%
0%
tPW1
tPW2
tSU
tHLD
tSU
tPD
tHLD
HI1171
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PDF描述 |
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参数描述 |
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