参数资料
| 型号： | HW-V4-ML401-USA |
| 厂商： | Xilinx Inc |
| 文件页数： | 29/40页 |
| 文件大小： | 0K |
| 描述： | EVALUATION PLATFORM VIRTEX-4 |
| 标准包装： | 1 |
| 配用： | HW-AFX-BERG-EPHY-ND - DAUGHTER CARD PHY BERG-EPHY |
| 其它名称： | 122-1505 |
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R
ML40x Demonstrations in Linear Flash
uploaded. In this step, the CPU reads * .bit files from the CompactFlash and writes them
into linear flash. Up to eight different configurations can be stored in the flash.
Virtex-4 FPGA
CompactFlash
Memory
CompactFlash
Interface
CPU
Flash
Interface
Linear
Flash
UG083_06_022805
Figure 8:
Linear Flash Configuration Process: Step 1
step, the CPLD (95144XL) reads the flash and configures the FPGA. DIP switches on the
ML40 x board select which bitstream to download. The FPGA is configured in slave-serial
mode.
Linear
Flash
95144XL
CPLD
Virtex-4
FPGA
UG083_07_022805
Figure 9:
Linear Flash Configuration Process: Step 2
ML40x Getting Started Tutorial
UG083 (v5.0) June 30, 2006
29
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