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参数资料
| 型号： | ICS1526GLF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 8/11页 |
| 文件大小： | 0K |
| 描述： | IC VIDEO CLK SYNTHESIZER 16TSSOP |
| 标准包装： | 96 |
| 类型： | 时钟/频率合成器，频率时序发生器 |
| PLL： | 带旁路 |
| 输入： | LVTTL |
| 输出： | LVCMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:1 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 110MHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 16-TSSOP |
| 包装： | 管件 |
| 其它名称： | 1526GLF 800-2352-5 ICS1526GLF-ND |
MDS 1526 P
6
Revision 051310
Integrated Device Technology, Inc. www.idt. com Tech Support: www.idt.com/go/clockhelp
(IDT/ICS)
Section 3 Register map summary
ICS1526 Data Sheet
07h
Osc_Div
R / W
Osc_Div 0-6
0-6
0
Osc Divider modulus
Minimum 3 =0000001 binary, Maximum 129 = 1111111 binary
Divider setting = 7-bit word + 2
In-Sel
7
0
Input Select
0=OSC Input, 1=HSYNC Input,
OSC input clock must be present to select OSC input
08h
Reset
Write
PLL
0-7
x
Writing 5Ah resets PLL and commits values written to word
addresses 01h-03h and 05h
09-0Fh
Reserved
Read
Reserved
0-7
Reserved
10h
Chip Ver
Read
Reserved
0-7
Reserved
11h
Chip Rev
Read
Chip Rev
0-7
01
Reserved
12h
Rd_Reg
Read
Reserved
0
N/A
Reserved
PLL_Lock
1
N/A
PLL Lock Status
0=Unlocked, 1=Locked
Reserved
2-7
0
Reserved
*. Written values to these registers do not take effect immediately, but require a commit via register 08h
Word
Address
Name
Access
Bit Name
Bit#
Reset
Value
Description
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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