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参数资料
| 型号： | ICS1894KI-40LFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 37/53页 |
| 文件大小： | 0K |
| 描述： | PHYCEIVER LOW PWR 3.3V 40QFN |
| 标准包装： | 1 |
| 系列： | PHYceiver™ |
| 类型： | PHY 收发器 |
| 规程： | MII，RMII |
| 电源电压： | 3.14 V ~ 3.47 V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 40-VFQFN 裸露焊盘 |
| 供应商设备封装： | 40-VFQFPN（6x6） |
| 包装： | 标准包装 |
| 其它名称： | 800-2032-6 |
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ICS1894-40
10BASE-T/100BASE-TX INTEGRATED PHYCEIVER WITH RMII INTERFACE
PHYCEIVER
IDT 10BASE-T/100BASE-TX INTEGRATED PHYCEIVER WITH RMII INTERFACE
42
ICS1894-40
REV K 022412
10M MII: Carrier Assertion/De-Assertion (Half-Duplex Transmission)
The table below lists the significant time periods for the 10M MII carrier assertion/de-assertion during half-duplex
transmission. The time periods consist of timings of signals on the following pins:
TXEN
TXCLK
CRS
The 10M MII Carrier Assertion/De-Assertion Timing Diagram (Half-Duplex Transmission Only) shows the timing diagram for
the time periods.
10M MII Carrier Assertion/De-Assertion Timing Diagram (Half-Duplex Transmission Only)
Time
Period
Parameter
Conditions
Min.
Typ.
Max.
Units
t1
TXEN Asserted to CRS Assert
0
–
2
Bit times
t2
TXEN De-Asserted to CRS De-Asserted
0
2
4
Bit times
t2
t1
TXEN
TXCLK
CRS
相关PDF资料 |
PDF描述 |
|---|---|
| ID82C55A | IC I/O EXPANDER 24B 40DIP |
| ID82C82 | IC DRIVER BUS OCT LATCHING 20DIP |
| ID82C86H | IC TRANSCEIVER OCT BUS 20-DIP |
| IDT5V5201DCGI | TXRX 1CH M-LVDS TO LVTTL 8-SOIC |
| IDT5V5206DCGI | TXRX 1CH M-LVDS TO LVTTL 8-SOIC |
相关代理商/技术参数 |
参数描述 |
|---|---|
| ICS1894KI-43LFT | 制造商:Integrated Device Technology Inc 功能描述:PHYCEIVER LOW PWR 3.3V 40QFN |
| ICS200 | 制造商:ICS 制造商全称:ICS 功能描述:SMPTE Time Code Receiver/Generator |
| ICS2001M | 制造商:未知厂家 制造商全称:未知厂家 功能描述:8-Bit Digital-to-Analog Converter |
| ICS2001N | 制造商:未知厂家 制造商全称:未知厂家 功能描述:8-Bit Digital-to-Analog Converter |
| ICS2002 | 制造商:ICS 制造商全称:ICS 功能描述:Wavedec Digital Audio Codec |
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