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参数资料
| 型号： | ICS271PGILFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 9/11页 |
| 文件大小： | 0K |
| 描述： | VCXO CLK TRPL PLL PROGR 20-TSSOP |
| 标准包装： | 2,500 |
| 系列： | VersaClock™ |
| 类型： | 时钟/频率合成器，扇出缓冲器（分配） |
| PLL： | 带旁路 |
| 输入： | 晶体 |
| 输出： | CMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:6 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 200MHz |
| 除法器/乘法器： | 是/是 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 20-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 20-TSSOP |
| 包装： | 带卷 (TR) |
| 其它名称： | 271PGILFT |
ICS271
TRIPLE PLL FIELD PROGRAMMABLE VCXO CLOCK SYNTHESIZER
EPROM VCXO AND SYNTHESIZER
IDT / ICS TRIPLE PLL FIELD PROGRAMMABLE VCXO CLOCK SYNTHESIZER 7
ICS271
REV E 051310
Note 1: External crystal device must conform with Pullable Crystal Specifications listed on page 3.
Note 2: Measured with 15 pF load, VDDO = 3.3 V at VDDO/2.
Note 3: Duty Cycle is configuration dependent. Most configurations are min 45% / max 55%
Thermal Characteristics
Power-up time
PLL lock-time from
power-up
410
ms
PDTS goes high until
stable CLK output
0.6
2
ms
One Sigma Clock Period Jitter
Configuration Dependent
50
ps
Maximum Absolute Jitter
tja
Deviation from Mean.
Configuration Dependent
+200
ps
Pin-to-Pin Skew
Low Skew Outputs
-250
250
ps
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Thermal Resistance Junction to
Ambient
θJA
Still air
93
° C/W
θJA
1 m/s air flow
78
° C/W
θJA
3 m/s air flow
65
° C/W
Thermal Resistance Junction to Case
θJC
20
° C/W
Parameter
Symbol
Conditions
Min.
Typ.
Max. Units
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PDF描述 |
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参数描述 |
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