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参数资料
| 型号： | ICS280PGLFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 1/9页 |
| 文件大小： | 0K |
| 描述： | IC CLK SYNTH TRPL PLL 16-TSSOP |
| 标准包装： | 2,500 |
| 系列： | VersaClock™ |
| 类型： | 时钟/频率合成器，扇出配送，扩展频谱时钟发生器 |
| PLL： | 带旁路 |
| 输入： | 时钟，晶体 |
| 输出： | CMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:4 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 200MHz |
| 除法器/乘法器： | 是/是 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 16-TSSOP |
| 包装： | 带卷 (TR) |
| 其它名称： | 280PGLFT |
DATASHEET
TRIPLE PLL FIELD PROG. SPREAD SPECTRUM CLOCK SYNTHESIZER
ICS280
IDT TRIPLE PLL FIELD PROG. SPREAD SPECTRUM CLOCK SYNTHESIZER
1
ICS280
REV G 030212
Description
The ICS280 field programmable spread spectrum clock
synthesizer generates up to four high-quality,
high-frequency clock outputs including multiple reference
clocks from a low-frequency crystal input. It is designed to
replace crystals, crystal oscillators and stand alone spread
spectrum devices in most electronic systems.
Using IDT’s VersaClockTM software to configure PLLs and
outputs, the ICS280 contains a One-Time Programmable
(OTP) ROM for field programmability. Programming
features include input/output frequencies, spread spectrum
amount and eight selectable configuration registers.
Using Phase-Locked Loop (PLL) techniques, the device
runs from a standard fundamental mode, inexpensive
crystal, or clock. It can replace multiple crystals and
oscillators, saving board space and cost.
The ICS280 is also available in factory programmed custom
versions for high-volume applications.
Features
Packaged as 16-pin TSSOP – Pb-free, RoHS compliant
Eight addressable registers
Replaces multiple crystals and oscillators
Output frequencies up to 200 MHz at 3.3 V
Configurable Spread Spectrum Modulation
Input crystal frequency of 5 to 27 MHz
Input clock frequency of 3 to 166 MHz
Up to four reference outputs
Operating voltages of 3.3 V
Controllable output drive levels
Advanced, low-power CMOS process
Block Diagram
Crystal
Oscillator
GND
3
VDD
PDTS
PLL2
PLL3
Divide
Logic
and
Output
Enable
Control
S2:S0
3
OTP
ROM
with PLL
Values
X2
Crystal or
Clock Input
External capacitors
are required with a crystal input.
X1/ICLK
PLL1 with
Spread
Spectrum
CLK1
CLK3
CLK4
CLK2
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
|---|---|
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