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参数资料
| 型号： | ICS308RILF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 7/9页 |
| 文件大小： | 0K |
| 描述： | IC SRL PROGR QUAD PLL CLK 20QSOP |
| 标准包装： | 55 |
| 系列： | VersaClock™ |
| 类型： | 时钟/频率合成器 |
| PLL： | 带旁路 |
| 输入： | 时钟，晶体 |
| 输出： | LVCMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:9 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 200MHz |
| 除法器/乘法器： | 无/是 |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 20-SSOP（0.154"，3.90mm 宽） |
| 供应商设备封装： | 20-QSOP |
| 包装： | 管件 |
| 其它名称： | 308RILF |
ICS308
SERIAL PROGRAMMABLE QUAD PLL VERSACLOCK SYNTHESIZER
SER PROG CLOCK SYNTHESIZER
IDT / ICS SERIAL PROGRAMMABLE QUAD PLL VERSACLOCK SYNTHESIZER 7
ICS308
REV L 051310
AC Electrical Characteristics
VDD = 3.3 V±10%, Ambient Temperature -40 to +85
° C, unless stated otherwise
Note 1: Measured with 15 pF load.
Note 2: Duty Cycle is configuration dependent. Most configurations are min 45% / max 55%
Thermal Characteristics
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Input Frequency
FIN
Fundamental crystal
5
27
MHz
Input Clock
2
50
MHz
Output Frequency
VDD=3.3 V
0.25
200
MHz
Output Clock Rise Time
tOR
20% to 80%, Note 1
0.8
ns
Output Clock Fall Time
tOF
80% to 20%, Note 1
0.8
ns
Output Clock Duty Cycle
Note 2
40
49-51
60
%
Power-up Time
STROBE goes high until
stable CLK out
310
ms
PDTS goes high until
stable CLK out
.2
2
ms
Maximum Output Jitter, short term
tj
Reference Clock
±300
ps
Maximum Output Jitter, short term
tj
All other clocks,
CL=15 pF, configuration
dependent
±200
ps
Pin-to-Pin Skew
Low Skew Outputs
-250
250
ps
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Thermal Resistance Junction to
Ambient
θJA
Still air
135
° C/W
θJA
1 m/s air flow
93
° C/W
θJA
3 m/s air flow
78
° C/W
Thermal Resistance Junction to Case
θJC
60
° C/W
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PDF描述 |
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参数描述 |
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