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参数资料
| 型号： | ICS487G-25T |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 5/7页 |
| 文件大小： | 0K |
| 描述： | IC QUAD PLL FOR DTV 16-TSSOP |
| 产品变化通告： | Product Discontinuation 13/May/2009 |
| 标准包装： | 2,500 |
| 类型： | 锁相环路（PLL） |
| PLL： | 是 |
| 输入： | 时钟，晶体 |
| 输出： | LVCMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:5 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 48MHz |
| 除法器/乘法器： | 无/无 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 16-TSSOP |
| 包装： | 带卷 (TR) |
| 其它名称： | 487G-25T |
ICS487-25
QUAD PLL FOR DTV
CLOCK SYNTHESIZER
IDT / ICS QUAD PLL FOR DTV
5
ICS487-25
REV B 092109
AC Electrical Characteristics
Unless stated otherwise, VDD = 3.3 V ±5%, Ambient Temperature 0 to +70
° C
Note 1: Measured with a 15 pF load.
Thermal Characteristics
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Input Frequency
fIN
27
MHz
Output Rise Time
tOR
20% to 80%, Note 1
1.2
ns
Output Fall Time
tOF
80% to 20%, Note 1
1.0
ns
Output Clock Duty Cycle
at VDD/2, Note 1
45
50
55
%
Absolute Clock Period Jitter
Note 1
±175
ps
Frequency Synthesis Error
All outputs
0
ppm
Output Enable Time
tOE
PDTS high to output
locked to ±1%
250
s
Output Disable Time
tOD
PDTS low to tri-state
20
ns
Audio Clock Stabilization Time
Time from a change
in S1 or S0 until
output stable within
±1%
50
s
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Thermal Resistance Junction to
Ambient
θJA
Still air
78
° C/W
θJA
1 m/s air flow
70
° C/W
θJA
3 m/s air flow
68
° C/W
Thermal Resistance Junction to Case
θJC
37
° C/W
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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