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参数资料
| 型号： | ICS501AMLF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 4/6页 |
| 文件大小： | 0K |
| 描述： | IC PLL CLK MULTIPLIER 8-SOIC |
| 标准包装： | 97 |
| 系列： | LOCO™ |
| 类型： | 时钟发生器 |
| PLL： | 是 |
| 输入： | 时钟，晶体 |
| 输出： | CMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:1 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 200MHz |
| 除法器/乘法器： | 无/是 |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 8-SOIC（0.154"，3.90mm 宽） |
| 供应商设备封装： | 8-SOIC |
| 包装： | 管件 |
| 其它名称： | 501AMLF 800-2370-5 ICS501AMLF-ND |
ICS501A
LOCO PLL CLOCK MULTIPLIER
CLOCK MULTIPLIER
IDT LOCO PLL CLOCK MULTIPLIER
4
ICS501A
REV H 113011
DC Electrical Characteristics
VDD=3.3 V ±10% , Ambient temperature -40 to +85
° C, unless stated otherwise
AC Electrical Characteristics
VDD = 3.3 V ±10%, Ambient Temperature -40 to +85
° C, unless stated otherwise
Note 1: Measured with 15 pF load.
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Operating Voltage
VDD
3.0
3.6
V
Input High Voltage, ICLK only
VIH
ICLK (pin 1)
(VDD/2)+1
V
Input Low Voltage, ICLK only
VIL
ICLK (pin 1)
(VDD/2)-1
V
Input High Voltage
VIH
OE (pin 7)
2.0
V
Input Low Voltage
VIL
OE (pin 7)
0.8
V
Input High Voltage
VIH
S0, S1
VDD-0.5
V
Input Low Voltage
VIL
S0, S1
0.5
V
Output High Voltage
VOH
IOH = -12 mA
2.4
V
Output Low Voltage
VOL
IOL = 12 mA
0.4
V
IDD Operating Supply Current, 20
No load, 100M
20
mA
Short Circuit Current
CLK output
+70
mA
On-Chip Pull-up Resistor
Pin 7
270
k
Ω
Input Capacitance, S1, S0, and OE
Pins 4, 6, 7
4
pF
Nominal Output Impedance
20
Ω
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Input Frequency, crystal input
FIN
see page 2
27
MHz
Input Frequency, clock input
FIN
see page 2
50
MHz
Output Frequency, VDD = 3.0 to 3.6 V
FOUT
0
° C to +70° C200
MHz
-40
° C to +85° C166
MHz
Output Clock Rise Time
tOR
0.8 to 2.0 V, Note 1
1
ns
Output Clock Fall Time
tOF
2.0 to 8.0 V, Note 1
1
ns
Output Clock Duty Cycle
tOD
1.5 V, up to 160
MHz
45
49-51
55
%
PLL Bandwidth
120
kHz
Output Enable Time, OE high to
output on
50
ns
Output Disable Time, OE low to
tri-state
50
ns
Absolute Clock Period Jitter
tja
Deviation from mean
+70
ps
One Sigma Clock Period Jitter
tjs
25
ps
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